[发明专利]提高△-Σ模数转换器中过量环路延迟补偿的效率在审
| 申请号： | 202080066703.8 | 申请日： | 2020-09-24 |
| 公开（公告）号： | CN114503437A | 公开（公告）日： | 2022-05-13 |
| 发明（设计）人： | 志方明;A·班德约帕得哈 | 申请（专利权）人： | 美国亚德诺半导体公司 |
| 主分类号： | H03M3/00 | 分类号： | H03M3/00 |
| 代理公司： | 中国贸促会专利商标事务所有限公司 11038 | 代理人： | 张小稳 |
| 地址： | 美国马*** | 国省代码： | 暂无信息 |
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| 摘要： | 提供用于提高Δ‑Σ模数转换器中过量环路延迟补偿的效率的系统和方法。在一些例子中，提供用于减小用于连续时间Δ‑ΣADC的量化器中的嵌入的过量环路延迟补偿数模转换器(DAC)中的总电容的系统和方法。在其他例子中，过量环路延迟补偿DAC可以是电流域DAC、电荷域DAC或电压域DAC。另外，提供用于数字控制过量环路延迟DAC的增益的方法。而且，提供校准主逐次逼近寄存器DAC和过量环路延迟DAC之间的增益失配的方法。本文提供的系统和方法提高连续时间Δ‑ΣADC的性能。连续时间Δ‑ΣADC是高精度和高能效ADC，通常用于音频播放设备和医疗设备。 | ||
| 搜索关键词： | 提高 转换器 过量 环路 延迟 补偿 效率 | ||
【主权项】：
暂无信息
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