[发明专利]一种基于OpenCL和FPGA的3DES加速方法在审
| 申请号： | 202011302847.7 | 申请日： | 2020-11-19 |
| 公开（公告）号： | CN112328401A | 公开（公告）日： | 2021-02-05 |
| 发明（设计）人： | 柴志雷;吴健凤 | 申请（专利权）人： | 江南大学 |
| 主分类号： | G06F9/50 | 分类号： | G06F9/50;G06F21/60 |
| 代理公司： | 苏州市中南伟业知识产权代理事务所(普通合伙) 32257 | 代理人： | 杨慧林 |
| 地址： | 215000 江苏*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明公开了一种基于OpenCL和FPGA的3DES加速方法，包括主机端与设备端，主机端基于OpenCL实现对内核的调度与管理，完成与设备端进行3DES加密和解密数据的交互；设备端设计在FPGA上，使用3DES对数据进行加密和解密；设备端包含明文数据输入缓存模块、3DES加密计算模块和密文数据输出缓存模块，明文数据输入缓存模块通过使用数据存储调整、数据位宽改进从全局内存读取明文数据，3DES加密计算模块通过对数据进行指令流优化形成流水线并行架构，密文数据输出缓存模块将数据从FPGA片上传输至外部DDR中。本发明采用数据存储调整、数据位宽改进和指令流优化，提高了内核实际带宽利用率和计算速度；采用内核矢量化策略和计算单元复制策略进一步提高性能。 | ||
| 搜索关键词： | 一种 基于 opencl fpga des 加速 方法 | ||
【主权项】：
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