[发明专利]一种RapidIO双通道数据实时组包传输方法在审

专利信息
申请号: 202011046447.4 申请日: 2020-09-29
公开(公告)号: CN112148660A 公开(公告)日: 2020-12-29
发明(设计)人: 翟栋梁;洪畅;刁志龙;杨阳 申请(专利权)人: 中国船舶重工集团公司第七二四研究所;中国船舶集团有限公司
主分类号: G06F13/40 分类号: G06F13/40;G06F13/42
代理公司: 暂无信息 代理人: 暂无信息
地址: 210003 *** 国省代码: 江苏;32
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摘要: 发明提出了一种RapidIO双通道实时组包的传输方法,属于通信技术领域,本发明采用FPGA作为主控芯片,内部由协议接口模块,数据缓存模块,实时组包控制模块组成。其中实时组包模块是实现高效重组传输的主体部分,该模块通过对主通道和副通道数据流的交互控制,实现了两个通道的报文以Nwrite+Nwrite_R+Doorbell方式顺序传输至不同RapidIO节点或地址。本发明在实现自定义协议数据流与RapidIO协议实时转换的基础上,优化了双通道数据转入RapidIO总线的效率,并且本方法可以作为功能IP核嵌入任何FPGA程序中,使得FPGA对RapidIO总线读写开发简化、灵活性提高。
搜索关键词: 一种 rapidio 双通道 数据 实时 传输 方法
【主权项】:
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