[发明专利]FPGA配置模块及其测试信号分组输出的实现方法、电路有效
| 申请号： | 202010561448.6 | 申请日： | 2020-06-18 |
| 公开（公告）号： | CN111709201B | 公开（公告）日： | 2023-09-15 |
| 发明（设计）人： | 刘小成 | 申请（专利权）人： | 上海安路信息科技股份有限公司 |
| 主分类号： | G06F30/32 | 分类号： | G06F30/32;G06F115/02 |
| 代理公司： | 上海恒锐佳知识产权代理事务所(普通合伙) 31286 | 代理人： | 黄海霞 |
| 地址： | 200434 上海市*** | 国省代码： | 上海;31 |
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| 摘要： | 本申请公开了FPGA配置模块及其测试信号分组输出的实现方法、电路、电子设备、计算机可读存储介质，该方法包括：将待测试信号分组为第一组至第N组，N是正整数；向分组输出物理管脚发送第k组待测试信号，以使所述分组输出物理管脚输出所述第k组待测试信号，k是不大于N的正整数。对待测试信号进行分组，并通过分组输出物理管脚实时输出其中一组待测试信号，待测试信号经过较少分组输出物理管脚直接输出，达到可以实时观测待测试信号的目的，由此，解决了采用JTAG接口输出待测试信号时工作速率受限于TCK时钟频率，当FPGA配置模块内部的逻辑变化速率较快时，JTAG无法实时采样测试信号的问题。 | ||
| 搜索关键词： | fpga 配置 模块 及其 测试 信号 分组 输出 实现 方法 电路 | ||
【主权项】：
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