[发明专利]一种全差分静态逻辑超高速D触发器在审
| 申请号： | 201911354499.5 | 申请日： | 2019-12-25 |
| 公开（公告）号： | CN111082783A | 公开（公告）日： | 2020-04-28 |
| 发明（设计）人： | 唐枋;黄天聪;李志鹏;李润林 | 申请（专利权）人： | 重庆大学 |
| 主分类号： | H03K3/3562 | 分类号： | H03K3/3562 |
| 代理公司： | 重庆越利知识产权代理事务所(普通合伙) 50258 | 代理人： | 周兆华 |
| 地址： | 400000 *** | 国省代码： | 重庆;50 |
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| 摘要： | 本发明公开了集成电路设计技术领域的一种全差分静态逻辑超高速D触发器，包括对应设置的dip差分信号输入模块和ckop差分信号输出模块以及对应设置的din差分信号输入模块和ckon差分信号输出模块，所述dip差分信号输入模块和ckop差分信号输出模块的连接端以及din差分信号输入模块和ckon差分信号输出模块的连接端均依次连接有传送门模块、第一反向器模块和第二反向器模块，所述传送门模块上连接有差分时钟信号模块，本发明电路的仿真平台与传统家头相比，电路由smic40nm工艺实现，实现了触发器可以在超高频率下依然可以正常运行，电路在速度上得到了大大的提高。 | ||
| 搜索关键词： | 一种 全差分 静态 逻辑 超高速 触发器 | ||
【主权项】：
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