[发明专利]同步故障注入的故障攻击防护在审
| 申请号： | 201910508552.6 | 申请日： | 2019-06-12 |
| 公开（公告）号： | CN110598484A | 公开（公告）日： | 2019-12-20 |
| 发明（设计）人： | 斯特凡·多尔;马库斯·雷格纳;桑迪普·贾殷 | 申请（专利权）人： | 恩智浦有限公司 |
| 主分类号： | G06F21/72 | 分类号： | G06F21/72 |
| 代理公司： | 11021 中科专利商标代理有限责任公司 | 代理人： | 倪斌 |
| 地址： | 荷兰埃因霍温高科*** | 国省代码： | 荷兰;NL |
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| 摘要： | 本发明涉及同步故障注入的故障攻击防护。各种实施例涉及一种电路，其包括：第一安全电路，其被配置成接收输入并产生第一输出；第一延迟电路，其被配置成接收所述第一输出并产生延迟时间N的第一延迟输出；第二延迟电路，其被配置成接收所述输入并产生延迟时间N的延迟输入；第二安全电路，其被配置成接收所述延迟输入并产生第二延迟输出；以及比较器，其被配置成比较所述第一延迟输出与所述第二延迟输出并产生结果，其中当所述第一延迟输出匹配所述第二延迟输出时所述结果是所述第一延迟输出或所述第二延迟输出中的一个且当所述第一延迟输出不匹配所述第二延迟输出时所述结果是误差值。 | ||
| 搜索关键词： | 延迟输出 延迟 配置 安全电路 延迟电路 匹配 故障攻击 接收输入 同步故障 输出 比较器 电路 防护 | ||
【主权项】：
1.一种电路，其特征在于，包括：/n第一安全电路，其被配置成接收输入并产生第一输出；/n第一延迟电路，其被配置成接收所述第一输出并产生延迟时间N的第一延迟输出；/n第二延迟电路，其被配置成接收所述输入并产生延迟时间N的延迟输入；/n第二安全电路，其被配置成接收所述延迟输入并产生第二延迟输出；以及/n比较器，其被配置成比较所述第一延迟输出与所述第二延迟输出并产生结果，其中当所述第一延迟输出匹配所述第二延迟输出时所述结果是所述第一延迟输出或所述第二延迟输出中的一个，且当所述第一延迟输出不匹配所述第二延迟输出时所述结果是误差值。/n
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