[发明专利]用于多处理器之间的数据处理的方法和电子装置有效
| 申请号： | 201880008043.0 | 申请日： | 2018-01-23 |
| 公开（公告）号： | CN110199269B | 公开（公告）日： | 2023-08-29 |
| 发明（设计）人： | 金洛琦;安珉旭;琴炅穆;申健澈 | 申请（专利权）人： | 三星电子株式会社 |
| 主分类号： | G06F13/38 | 分类号： | G06F13/38;G06F12/1081 |
| 代理公司： | 北京铭硕知识产权代理有限公司 11286 | 代理人： | 朱志玲;于硕 |
| 地址： | 韩国京畿*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种电子装置可包括：第一存储器，用于以指定速率存储第一数据；第一处理器，被连接到第一存储器，并且被配置为将第一数据划分成多个第二数据，其中，每个第二数据的大小小于第一数据的大小；第二存储器，用于以比指定速率快的速率存储所述多个第二数据中的至少一些第二数据；第二处理器，被连接到第二存储器，并且被配置为处理所述多个第二数据中的至少一些第二数据；以及DMA控制模块，被连接到第二处理器，用于在第一存储器与第二存储器之间发送/接收数据，其中，DMA控制模块被配置为：至少基于从第一处理器发送到第二处理器的针对所述多个第二数据的处理命令，从第一存储器接收从第一数据划分出的小的大小的所述多个第二数据中的至少一些第二数据；将所述多个第二数据中的至少一些第二数据发送到第二处理器；并且将由第二处理器通过使用所述多个第二数据中的至少一些第二数据产生的第三数据发送到第一存储器。 | ||
| 搜索关键词： | 用于 处理器 之间 数据处理 方法 电子 装置 | ||
【主权项】：
1.一种电子装置，包括：第一存储器，以指定速度存储第一数据；第一处理器，与第一存储器连接，并且被配置为将第一数据划分成多个第二数据，其中，每个第二数据的大小小于第一数据的大小；第二存储器，以高于所述指定速度的速度存储所述多个第二数据中的至少一些第二数据；第二处理器，与第二存储器连接，并且被配置为处理所述多个第二数据中的至少一些第二数据；以及直接存储器访问DMA控制模块，与第二处理器连接，并且被配置为在第一存储器与第二存储器之间发送和接收数据，其中，DMA控制模块被配置为：至少基于从第一处理器发送到第二处理器的针对所述多个第二数据的处理命令，从第一存储器接收从第一数据划分出的较小大小的所述多个第二数据中的至少一些第二数据；将所述多个第二数据中的至少一些第二数据发送到第二处理器；并且将由第二处理器使用所述多个第二数据中的至少一些第二数据处理的第三数据发送到第一存储器。
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