[发明专利]半导体存储器的控制电路及半导体存储器在审

专利信息
申请号: 201810367566.6 申请日: 2018-04-23
公开(公告)号: CN108320770A 公开(公告)日: 2018-07-24
发明(设计)人: 不公告发明人 申请(专利权)人: 睿力集成电路有限公司
主分类号: G11C11/4076 分类号: G11C11/4076;G11C11/4074
代理公司: 北京市铸成律师事务所 11313 代理人: 宋珊珊;王珺
地址: 230000 安徽省合肥市*** 国省代码: 安徽;34
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摘要: 发明公开一种半导体存储器及用于控制半导体存储器功能模块工作状态的控制电路,半导体存储器包括n个功能模块,控制电路包括分时控制电路和n个电源驱动模块;分时控制电路包括用于接收总控制信号的输入端,并根据总控制信号产生边沿依次错开的n个使能信号;电源驱动模块分别与使能信号输出端和功能模块连接,电源驱动模块用于根据所接收的使能信号控制对应的功能模块的工作状态,n个电源驱动模块分别根据n个使能信号控制功能模块依次顺序导通并以相反的顺序关断。本发明半导体存储器控制电路通过半导体存储器不同操作按照响应顺序分时开启或者关闭,有效降低了同时开启或者关闭时半导体存储器的峰值电流,且减小了半导体存储器的功耗。
搜索关键词: 半导体存储器 电源驱动模块 控制电路 使能信号 分时控制电路 总控制信号 控制功能模块 模块工作状态 分时开启 峰值电流 模块连接 输出端 输入端 错开 导通 功耗 关断 减小 响应
【主权项】:
1.一种用于控制半导体存储器功能模块工作状态的控制电路,所述半导体存储器包括n个功能模块,n是大于等于2的正整数,其特征在于,所述控制电路包括:分时控制电路,包括用于接收总控制信号的总控制信号输入端,所述分时控制电路用于根据所述总控制信号产生边沿依次错开的n个使能信号,其中,所述使能信号分别经由n个使能信号输出端输出;以及n个电源驱动模块,一个所述电源驱动模块与一个所述使能信号输出端连接以接收所述使能信号,且一个所述电源驱动模块与一个所述功能模块连接,所述电源驱动模块用于根据所接收的使能信号控制对应的功能模块的工作状态,其中,n个所述电源驱动模块分别根据n个所述使能信号依次顺序导通并以相反的顺序关闭。
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