[发明专利]用于检测数值累加误差的指令和逻辑有效
| 申请号： | 201780060529.4 | 申请日： | 2017-08-30 |
| 公开（公告）号： | CN109791513B | 公开（公告）日： | 2023-04-18 |
| 发明（设计）人： | I.帕多;O.本-基基 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F11/07 | 分类号： | G06F11/07;G06F7/483 |
| 代理公司： | 中国专利代理(香港)有限公司 72001 | 代理人： | 徐红燕;陈岚 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种处理器包括用于对至少一个指令进行解码的电路以及执行单元。经解码的指令可以计算浮点结果。所述执行单元包括用于进行以下各项的电路：执行指令以确定浮点结果，计算浮点结果的尾数中损失的精度量，比较损失的精度量与数值累加误差精度阈值，基于所述比较而确定是否出现数值累加误差，以及将值写到一标志。所述损失的精度量对应于浮点结果的尾数中丢失的多个位。将被写到标志的值可以基于确定了出现数值累加误差。所述标志可以用于通知出现了数值累加误差。 | ||
| 搜索关键词： | 用于 检测 数值 累加 误差 指令 逻辑 | ||
【主权项】：
1.一种处理器，包括：用于对至少一个指令进行解码的电路，所述指令用于计算浮点结果；执行单元，所述执行单元包括用于进行以下各项的电路：执行所述指令来确定浮点结果；计算浮点结果的尾数中损失的精度量，所述损失的精度量对应于浮点结果的尾数中丢失的多个位；比较浮点结果的尾数中损失的精度量与数值累加误差精度阈值；基于在浮点结果的尾数中损失的精度量与数值累加误差精度阈值之间的比较而确定是否出现数值累加误差；以及将值写到一标志以用于通知出现了数值累加误差，该值基于确定了出现数值累加误差。
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