[发明专利]集成电路器件结构和双侧制造技术在审

专利信息
申请号: 201780046264.2 申请日: 2017-08-25
公开(公告)号: CN109643742A 公开(公告)日: 2019-04-16
发明(设计)人: B·布洛克;V·R·拉奥;R·米恩德鲁;D·因格利;K·俊;K·奥布莱恩;P·莫罗;P·菲舍尔;S·S·廖 申请(专利权)人: 英特尔公司
主分类号: H01L31/18 分类号: H01L31/18;H01L31/042;H02S20/20
代理公司: 永新专利商标代理有限公司 72002 代理人: 林金朝;王英
地址: 美国加*** 国省代码: 美国;US
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摘要: 集成电路单元架构包括前侧和背侧结构二者。背侧注入、半导体沉积、电介质沉积、金属化、膜图案化和晶片层级层转移中的一种或多种与前侧处理集成。这种双侧处理可能需要显露从衬底的前侧制造的结构的背侧。可以构建宿主‑施主衬底组件以在背侧处理期间支撑并保护前侧结构。可以在背侧处理期间修改和/或互连前侧器件,例如FET。可以将诸如FET的背侧器件与前侧器件集成以扩展器件功能、改善性能或增大器件密度。
搜索关键词: 处理期间 集成电路器件结构 宿主 技术集成电路 半导体沉积 电介质沉积 背侧结构 衬底组件 单元架构 改善性能 扩展器件 器件集成 层级层 金属化 膜图案 互连 衬底 构建 晶片 制造 显露 支撑
【主权项】:
1.一种器件结构,包括:主体,所述主体包括单晶半导体材料、与隔离电介质相邻;与所述主体的侧壁相邻的栅极堆叠体,所述栅极堆叠体包括通过栅极电介质与所述侧壁分开的栅极电极;在所述栅极堆叠体的相对侧上耦合到所述主体的源极和漏极;耦合到所述源极、所述漏极或所述栅极电极中的至少一个的前侧互连金属化层;以及处于所述主体的与所述前侧互连金属化层相对的背侧表面之上的背侧器件层,其中,所述背侧器件层包括具有与所述主体的组分不同的组分的第二半导体材料;以及电耦合到所述背侧器件层的背侧器件端子。
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