[发明专利]高性能互连链路层有效
| 申请号： | 201711267378.8 | 申请日： | 2013-03-28 |
| 公开（公告）号： | CN107968756B | 公开（公告）日： | 2021-10-01 |
| 发明（设计）人： | J·威利;R·G·布兰肯希普;J·C·斯旺森;R·J·沙弗拉内克 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | H04L12/933 | 分类号： | H04L12/933;G06F12/0813;G06F12/0815;G06F13/22;G06F13/40;G06F13/42;H04L12/741 |
| 代理公司： | 永新专利商标代理有限公司 72002 | 代理人： | 刘瑜;王英 |
| 地址： | 美国加*** | 国省代码： | 暂无信息 |
| 权利要求书： | 查看更多 | 说明书： | 查看更多 |
| 摘要： | 识别事务数据，生成包括三个或多个时隙以及用作两个或多个时隙中的任一个的扩展的浮动字段的微片。在另一方案中，微片包括两个或多个时隙、有效载荷以及循环冗余校验(CRC)字段，所述CRC字段编码有基于有效载荷生成的16位CRC值。微片通过串行数据链路发送到装置以便至少部分地基于三个或多个时隙进行处理。 | ||
| 搜索关键词： | 性能 互连 链路层 | ||
【主权项】：
一种用于传输数据的装置，所述装置包括：链路层逻辑单元，其至少部分地被用硬件电路实现，其中，所述链路层逻辑单元用于：产生针对链路层微片的至少一部分的16位循环冗余校验(CRC)值；并且使该微片的16位CRC字段编码有所述CRC值，其中，所述微片包括至少三个时隙；以及发送逻辑单元，其用于向接收机发送所述微片。
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