[发明专利]一种基于HDL代码的硬件脆弱性评估方法在审
| 申请号： | 201711103362.3 | 申请日： | 2017-11-10 |
| 公开（公告）号： | CN107807812A | 公开（公告）日： | 2018-03-16 |
| 发明（设计）人： | 陈哲;王坚;郭世泽;李玉柏;高振标 | 申请（专利权）人： | 电子科技大学 |
| 主分类号： | G06F8/34 | 分类号： | G06F8/34;G06F11/36 |
| 代理公司： | 成都正华专利代理事务所(普通合伙)51229 | 代理人： | 李蕊,李林合 |
| 地址： | 611731 四川省成*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明公开了一种基于HDL代码的硬件脆弱性评估方法，以HDL开发的程序作为语法语义解析的输入，通过建立各个HDL模块的连接拓扑关系，并在此基础上计算各条边的脆弱性权值，以评估各模块的脆弱性大小，并进一步对各模块进行脆弱性等级划分。本发明为HDL程序的硬件脆弱性检测提供了指导，便于后续程序开发中加强设计，以提高程序系统的稳定性和可靠性。 | ||
| 搜索关键词： | 一种 基于 hdl 代码 硬件 脆弱 评估 方法 | ||
【主权项】：
一种基于HDL代码的硬件脆弱性评估方法，其特征在于，包括以下步骤：S1、编写脚本程序，把一个HDL程序文件作为脚本程序的输入，识别HDL程序中的模块数量，并分析与每个模块关联的边的数目；S2、提出HDL程序的硬件脆弱性分析策略，计算每条边的脆弱性权值，建立脆弱性权值拓扑图；S3、构建HDL程序的硬件脆弱性评价体系，根据脆弱性权值拓扑图对各模块进行硬件脆弱性分级；S4、编写图形界面，展示HDL程序中的模块连接关系以及各模块的硬件脆弱性级别。
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