[发明专利]一种基于信息记录结构体的DMA数据交互方法和装置有效
申请号: | 201711026587.3 | 申请日: | 2017-10-27 |
公开(公告)号: | CN107832240B | 公开(公告)日: | 2020-06-09 |
发明(设计)人: | 朱朝忠;刘云 | 申请(专利权)人: | 北京腾凌科技有限公司 |
主分类号: | G06F13/28 | 分类号: | G06F13/28 |
代理公司: | 北京博思佳知识产权代理有限公司 11415 | 代理人: | 陈蕾 |
地址: | 100085 北京市海淀区上地信息路*** | 国省代码: | 北京;11 |
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摘要: | 本公开提供了一种基于信息记录结构体的DMA数据交互方法和装置。创建多个应用于DMA数据交互的信息记录结构体,该信息记录结构体至少可存放数据段的长度信息,计数信息,内存空间地址信息和处理状态信息。信息记录结构体使DMA数据交互过程中的传输信息能够固定快速分配,主机和FPGA可以通过对多个信息记录结构体中处理状态标志位的监测获取每段数据的处理状态,进而能够快速准确对每段数据做出相应处理,提高了DMA传输过程的数据处理效率。 | ||
搜索关键词: | 一种 基于 信息 记录 结构 dma 数据 交互 方法 装置 | ||
【主权项】:
一种应用于DMA数据交互的信息记录结构体,其特征在于,所述信息记录结构体至少包括:数据段的长度信息;数据段的计数信息;数据段的内存空间地址信息,用于记录数据段在主机内存的存放地址;数据段的处理状态信息,用于标识所述数据段的处理情况,具体包括:状态A1:用于主机到FPGA方向的DMA数据交互,标识信息记录结构体处于初始状态;状态A2:用于主机到FPGA方向的DMA数据交互,标识主机已经将为数据段分配的内存空间地址信息写入信息记录结构体;状态A3:用于主机到FPGA方向的DMA数据交互,标识FPGA已经读取内存空间中的数据段;状态B1:用于FPGA到主机方向的DMA数据交互,标识信息记录结构体处于初始状态;状态B2:用于FPGA到主机方向的DMA数据交互,标识FPGA已经将数据段写入内存空间中。
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