[发明专利]低密度奇偶校验解码器、包括其的存储设备和方法有效
| 申请号： | 201710462821.0 | 申请日： | 2017-06-19 |
| 公开（公告）号： | CN107632903B | 公开（公告）日： | 2022-05-10 |
| 发明（设计）人： | 金志烨;申东旻;慎钒揆;孔骏镇;孙弘乐 | 申请（专利权）人： | 三星电子株式会社 |
| 主分类号： | G06F11/10 | 分类号： | G06F11/10;G11C29/42 |
| 代理公司： | 北京市柳沈律师事务所 11105 | 代理人： | 邵亚丽 |
| 地址： | 韩国*** | 国省代码： | 暂无信息 |
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| 摘要： | 低密度奇偶校验(LDPC)解码器可以包括可变节点处理单元和校验节点处理单元。校验节点处理单元包括存储校验节点值的存储器元件。存储器元件通过两个或更多个路径互连，并且每个路径可以包括存储器元件的全部或部分循环排列以发送校验节点值。 | ||
| 搜索关键词： | 密度 奇偶校验 解码器 包括 存储 设备 方法 | ||
【主权项】：
低密度奇偶校验(LDPC)解码器，包含：可变节点处理单元(VNU)，被配置为接收信道信息和校验节点信息，并且计算可变节点信息；校验节点处理单元(CNU)，被配置为接收所述可变节点信息，并且计算校验节点信息，其中，CNU包括存储相应校验节点值的多个存储器元件，所述存储器元件通过两个或更多个路径互连，每个路径包括存储器元件的全部或部分循环排列以发送校验节点值；以及存储器，被配置为暂时地存储在VNU的操作和CNU的操作期间生成的数据。
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