[发明专利]一种扫描单元以及栅极驱动电路有效
申请号: | 201710053585.7 | 申请日: | 2017-01-22 |
公开(公告)号: | CN107068032B | 公开(公告)日: | 2020-06-12 |
发明(设计)人: | 简守甫;夏志强;郭栋梁;曹兆铿 | 申请(专利权)人: | 上海中航光电子有限公司 |
主分类号: | G09G3/20 | 分类号: | G09G3/20 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 王宝筠 |
地址: | 201108 *** | 国省代码: | 上海;31 |
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摘要: | 本发明提供了一种扫描单元以及栅极驱动电路,通过增加第一下拉模块以及第三下拉节点M1,使得在第一上拉模块在响应于第一上拉节点P1的信号,对第一下拉节点Q1进行下拉时,第一下拉模块也对第一下拉节点Q1进行下拉操作。同理,对第二下拉节点Q2也进行双重下拉操作,减少了第一下拉节点Q1和第二下拉节点Q2在原有被下拉的过程中存在的下拉延时。进而,保证了第一上拉节点P1以及第二上拉节点P2同时被上拉,又由于第一上拉节点P1控制第一级子单元的第一输出端,第二上拉节点P2控制第二级子单元的第二输出端,因此,本扫描单元同时输出第一输出信号以及第二输出信号,解决栅极驱动电路的输出信号延时导致的显示装置画面不均匀的问题。 | ||
搜索关键词: | 一种 扫描 单元 以及 栅极 驱动 电路 | ||
【主权项】:
一种扫描单元,其特征在于,所述扫描单元包括:第一级子单元以及第二级子单元,其中,所述第一级子单元包括:第一输入模块、第一上拉节点、第一上拉控制模块、第二上拉控制模块、第一下拉节点、第一下拉控制模块、第二下拉控制模块、第一下拉生成模块、第一输出模块、第一下拉模块以及第三下拉节点;以及,所述第二级子单元包括:第二输入模块、第二上拉节点、第三上拉控制模块、第四上拉控制模块、第二下拉节点、第三下拉控制模块、第四下拉控制模块、第一下拉生成模块、第二输出模块、第二下拉模块以及第四下拉节点;所述第一输入模块响应于第一控制端的信号,控制第一电压端与所述第一上拉节点之间和控制第三电压端与所述第一输出端之间的接通状态,以及,响应于第二控制端的信号,控制第二电压端与所述第一上拉节点之间和控制所述第三电压端与所述第一输出端之间的接通状态,其中,所述第一电压端与所述第二电压端输出的信号的电平相反;所述第二输入模块响应于第三控制端的信号,控制所述第一电压端与所述第二上拉节点之间和控制所述第三电压端与所述第二输出端之间的接通状态,以及,响应于第四控制端的信号,控制所述第二电压端与所述第二上拉节点之间和控制所述第三电压端与所述第二输出端之间的接通状态,其中,所述第一输入模块与所述第二输入模块的结构相同;第一上拉控制模块响应于所述第一上拉节点的信号,控制所述第一下拉节点与所述第三电压端之间和控制所述第三电压端与所述第一下拉生成模块之间的接通状态;所述第二上拉控制模块响应于所述述第二上拉节点的信号,控制所述第一下拉节点与所述第三电压端之间和控制所述第一下拉节点与所述第一下拉生成模块之间的接通状态;第三上拉控制模块响应于所述第二上拉节点的信号,控制所述第二下拉节点与所述第三电压端之间和控制所述第二下拉节点与所述第二下拉生成模块之间的接通状态;所述第四上拉控制模块响应于所述述第一上拉节点的信号,控制所述第二下拉节点与所述第三电压端之间和控制所述第二下拉节点与所述第二下拉生成模块之间的接通状态,其中,所述第一上拉控制模块与所述第三上拉控制模块的结构相同,且所述第二上拉控制模块与所述第四上拉控制模块的结构相同;所述第一下拉生成模块响应于第一信号端的信号,控制所述第一信号端与所述第一下拉节点之间的接通状态;所述第二下拉生成模块响应于第二信号端的信号,控制所述第二控制信号端与所述第二下拉节点之间的接通状态,且所述第一下拉生成模块与所述第二下拉生成模块的结构相同;所述第一下拉控制模块响应于所述第一下拉节点的信号,控制所述第一上拉节点与所述第三电压端之间和控制所述第三电压端与所述第一输出端之间的接通状态;所述第二下拉控制模块响应于所述第二下拉节点的信号,控制所述第一上拉节点与所述第三电压端之间和控制所述第三电压端与所述第一输出端之间的接通状态;所述第三下拉控制模块响应于所述第二下拉节点的信号,控制所述第二上拉节点与所述第三电压端之间和控制所述第三电压端与所述第二输出端之间的接通状态;所述第四下拉控制模块响应于所述第一下拉节点的信号,控制所述第二上拉节点与所述第三电压端之间和控制所述第三电压端与所述第二输出端之间的接通状态,其中,所述第一下拉控制模块与所述第三下拉控制模块的结构相同,且所述第二下拉控制模块与所述第四下拉控制模块的结构相同;所述第一输出模块响应于所述第一上拉节点的信号,控制第一时钟信号与所述第一输出端之间的接通状态,以及,所述第二输出模块响应于所述第二上拉节点的信号,控制第二时钟信号与所述第二输出端之间的接通状态,其中,所述第一输出模块和所述第二输出模块的结构相同;所述第一下拉模块响应于所述第一控制端的信号,控制所述第一电压端与所述第三下拉节点之间的接通状态;所述第一下拉模块响应于所述第三下拉节点的信号,控制所述第三电压端与所述第一下拉节点之间的接通状态;所述第一下拉模块响应于所述第一输出端的信号,控制所述第三电压端与所述第三下拉节点之间的接通状态;所述第一下拉模块响应于所述第一下拉节点的信号,控制所述第三电压端与所述第三下拉节点之间的接通状态;所述第二下拉模块响应于所述第四控制端的信号,控制所述第二电压端与所述第四下拉节点之间的接通状态;所述第二下拉模块响应于所述第四下拉节点的信号,控制所述第三电压端与所述第二下拉节点之间的接通状态;所述第二下拉模块响应于所述第二输出端的信号,控制所述第三电压端与所述第四下拉节点之间的接通状态;所述第二下拉模块响应于所述第二下拉节点的信号,控制所述第三电压端与所述第四下拉节点之间的接通状态,其中,所述第一下拉模块与所述第二下拉模块的结构相同。
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