[发明专利]存储器系统中的单独链路和阵列纠错有效
| 申请号： | 201680067416.2 | 申请日： | 2016-09-28 |
| 公开（公告）号： | CN108292248B | 公开（公告）日： | 2021-06-25 |
| 发明（设计）人： | J·徐;D·I·威斯特 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | G06F11/10 | 分类号： | G06F11/10 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 王茂华;杜波 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 存储器设备可以包括链路纠错码(ECC)解码器和校正电路。ECC解码器和校正电路可以被布置在写入路径中并且被配置用于对通过数据链路接收到的写入数据进行链路错误的检测和校正。存储器设备还可以包括存储器ECC编码器电路。存储器ECC编码器电路可以被布置在写入路径中并且被配置用于在存储器阵列存储期间对写入数据进行存储器保护。 | ||
| 搜索关键词： | 存储器 系统 中的 单独 阵列 纠错 | ||
【主权项】：
1.一种存储器设备，包括：链路纠错码(ECC)解码器和校正电路，其在写入路径中并且被配置用于对通过数据链路接收到的写入数据进行链路错误检测和校正；以及存储器ECC编码器电路，其在所述写入路径中并被配置用于在存储器阵列存储期间对所述写入数据进行存储器保护。
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