[发明专利]针对基于块的处理器的调试支持有效
申请号: | 201680054433.2 | 申请日: | 2016-09-13 |
公开(公告)号: | CN108027731B | 公开(公告)日: | 2021-05-25 |
发明(设计)人: | D·C·伯格;A·L·史密斯 | 申请(专利权)人: | 微软技术许可有限责任公司 |
主分类号: | G06F9/38 | 分类号: | G06F9/38;G06F11/00;G06F11/36;G06F9/30 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 王茂华 |
地址: | 美国华*** | 国省代码: | 暂无信息 |
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摘要: | 公开了用于支持基于块的处理器架构中的程序的调试的系统和方法。在所公开的技术的一个示例中,一种处理器包括用于执行包括指令头部和多个指令的指令块的基于块的处理器核。基于块的处理器核包括执行控制逻辑和核状态访问逻辑。执行控制逻辑可以被配置为在默认执行模式期间调度多个指令中的相应指令用于按照动态顺序执行,并且在调试模式期间调度相应指令用于按照静态顺序执行。核状态访问逻辑可以被配置为在调试模式期间读取基于块的处理器核的中间状态并且在基于块的处理器核外部提供该中间状态。 | ||
搜索关键词: | 针对 基于 处理器 调试 支持 | ||
【主权项】:
1.一种包括基于块的处理器核的处理器,所述基于块的处理器核用于执行包括指令头部和多个指令的指令块,所述基于块的处理器核包括:执行控制逻辑,被配置为在默认执行模式期间调度所述多个指令中的相应指令用于按照动态顺序执行,并且在调试模式期间调度所述相应指令用于按照静态顺序执行,所述动态顺序是在所述指令块的执行期间并且基于所述多个指令的操作数何时准备好而被确定的,所述静态顺序是基于在所述指令块被执行之前可用的信息而被确定的;以及与所述执行控制逻辑通信的核状态访问逻辑,所述核状态访问逻辑被配置为仅在所述调试模式期间读取所述基于块的处理器核的中间状态并且在所述基于块的处理器核外部提供所述中间状态。
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