[实用新型]基于FPGA和ARM实时控制的数据传输系统有效
| 申请号： | 201620658672.6 | 申请日： | 2016-06-28 |
| 公开（公告）号： | CN205787773U | 公开（公告）日： | 2016-12-07 |
| 发明（设计）人： | 李培乐;徐汉超;吴剑锋 | 申请（专利权）人： | 苏州浩克系统检测科技有限公司 |
| 主分类号： | G05B19/042 | 分类号： | G05B19/042;G08C19/00 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 215300 江苏省*** | 国省代码： | 江苏;32 |
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| 摘要： | 本实用新型提供一种基于FPGA和ARM实时控制的数据传输系统，至少包括：电源模块、IO控制模块、FPGA模块、ARM控制模块和上位机；所述FPGA模块包括FPGA处理器、片外缓存模块和时钟控制模块，所述的IO控制模块、片外缓存模块和时钟控制模块均分别与FPGA处理器相连；所述ARM控制模块包括ARM控制器和与所述ARM控制器相连的存储器；所述ARM控制器与FPGA处理器、上位机相连；电源模块与所述的IO控制模块、FPGA处理器和ARM控制器均相连。本基于FPGA和ARM实时控制的数据传输系统能够完成被测数据无失真的、实时的、远距离与上位机的通信，并能接收上位机的控制指令，实现工作状态的远程交互。 | ||
| 搜索关键词： | 基于 fpga arm 实时 控制 数据传输 系统 | ||
【主权项】：
一种基于FPGA和ARM实时控制的数据传输系统，其特征在于，至少包括：电源模块（1）、IO控制模块（2）、FPGA模块、ARM控制模块和上位机（8）；所述FPGA模块包括FPGA处理器（3）、片外缓存模块（4）和时钟控制模块（5），所述的IO控制模块（2）、片外缓存模块（4）和时钟控制模块（5）均分别与所述FPGA处理器（3）相连；所述ARM控制模块包括ARM控制器（6）和与所述ARM控制器（6）相连的存储器（7）；所述ARM控制器（6）与FPGA处理器（3）、上位机（8）相连；电源模块（1）与所述的IO控制模块（2）、FPGA处理器（3）和ARM控制器（6）均相连。
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