[发明专利]一种时钟相位自适应的解调电路有效
| 申请号： | 201610352762.7 | 申请日： | 2016-05-26 |
| 公开（公告）号： | CN105959247B | 公开（公告）日： | 2018-12-11 |
| 发明（设计）人： | 马利远 | 申请（专利权）人： | 北京中电华大电子设计有限责任公司 |
| 主分类号： | H04L27/38 | 分类号： | H04L27/38 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 102209 北京市昌平区北七家未*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明涉及一种时钟相位自适应的解调电路，电路主要结构包括I路采样解调器、Q路采样解调器、比较器、时钟延迟控制电路、时钟延迟电路、IQ正交时钟产生电路。电路可实现时钟相位自适应，且电路结构实现简单，实现成本低。 | ||
| 搜索关键词： | 一种 时钟 相位 自适应 解调 电路 | ||
【主权项】：
1.一种时钟相位自适应的解调电路，电路主要结构包括I路采样解调器、Q路采样解调器、比较器、时钟延迟控制电路、时钟延迟电路、IQ正交时钟产生电路，其特征在于，调制载波信号RX同时输入到I路采样解调器和Q路采样解调器，I路采样解调器的输出作为上述解调电路的输出，Q路采样解调器的输出作为调整时钟相位的参考信号，可直接输出给比较器的一个输入端或经过其它处理如滤波后输出给比较器的一个输入端，比较器的另一输入端接基准电压，该基准电压与RX信号的直流电压相同，比较器的输出端连接到时钟延迟控制电路的输入端，时钟延迟控制电路根据比较器输出信号的状态输出控制信号给时钟延迟电路的一个输入端，时钟延迟电路另一输入端接本地时钟信号，时钟延迟电路根据时钟延迟控制电路的输入信号将本地时钟信号延迟一定的时间并将延迟后的时钟信号输出到IQ正交时钟产生电路，IQ正交时钟产生电路利用输入的延迟后的时钟信号产生正交的即相位相差90度的IQ两路信号并分别输出给I路采样解调器和Q路采样解调器，I路采样解调器和Q路采样解调器的电路结构完全相同。
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