[发明专利]锁存器和分频器有效
申请号: | 201410608586.X | 申请日: | 2014-10-31 |
公开(公告)号: | CN105634464B | 公开(公告)日: | 2019-03-12 |
发明(设计)人: | 吴毅强 | 申请(专利权)人: | 展讯通信(上海)有限公司 |
主分类号: | H03K19/0944 | 分类号: | H03K19/0944;H03K21/00 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 潘彦君;骆苏华 |
地址: | 201203 上海市浦东新区浦东*** | 国省代码: | 上海;31 |
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摘要: | 一种锁存器和分频器,所述锁存器包括:包括耦接于电源和地线之间的第一逻辑单元、与所述第一逻辑单元结构对称的第二逻辑单元,以及输入前馈控制单元,其中:所述第一逻辑单元具有第一控制端、第一输入端和第一输出端;所述第二逻辑单元具有第二控制端、第二输入端和第二输出端;所述输入前馈控制单元,适于根据输入所述第一输入端和第二输入端的输入信号,控制所述第一逻辑单元或者所述第二逻辑单元中电流通路的关闭。上述的方案可以消除锁存器在静态工作条件下的功耗,并同时降低动态工作条件下的动态功耗。 | ||
搜索关键词: | 锁存器 分频器 | ||
【主权项】:
1.一种锁存器,其特征在于,包括耦接于电源和地线之间的第一逻辑单元、与所述第一逻辑单元结构对称的第二逻辑单元,以及输入前馈控制单元,其中:所述第一逻辑单元具有第一控制端、第一输入端和第一输出端;所述第二逻辑单元具有第二控制端、第二输入端和第二输出端;所述输入前馈控制单元,适于根据输入所述第一输入端和第二输入端的输入信号,控制所述第一逻辑单元或者所述第二逻辑单元中电流通路的关闭;所述第一逻辑单元包括第一晶体管、第三晶体管和第五晶体管;所述第二逻辑单元包括第二晶体管、第四晶体管和第六晶体管;其中:所述第一晶体管和所述第二晶体管的栅端分别与所述第一控制端和所述第二控制端耦接,以及所述第一输出端和所述第四晶体管的栅端耦接,以及所述第二输出端和所述第三晶体管的栅端耦接,所述第三晶体管、所述第四晶体管、第五晶体管和所述第六晶体管的源端与地线耦接。
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