[发明专利]积分器输出摆幅降低有效
| 申请号： | 201410465061.5 | 申请日： | 2014-09-12 |
| 公开（公告）号： | CN104639172B | 公开（公告）日： | 2020-03-17 |
| 发明（设计）人： | D·N·奥尔里德;李纪鹏;R·E·施瑞尔;H·施巴塔 | 申请（专利权）人： | 亚德诺半导体集团 |
| 主分类号： | H03M3/00 | 分类号： | H03M3/00 |
| 代理公司： | 中国国际贸易促进委员会专利商标事务所 11038 | 代理人： | 申发振 |
| 地址： | 百慕大群岛(*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明涉及积分器输出摆幅降低。在一个示例实施方式中，本发明提供了一种用于时间连续ΣΔ模数转换器的回路滤波器。具体地，容性反馈数模转换器路径被布置在一连串运算放大器积分器中的第一运算放大器的输入处。第一运算放大器的输入处的容性反馈数模转换器减少了第一运算放大器的输出处的信号内容，从而降低了第一运算放大器的输出摆幅。输出摆幅的降低提供了更有效的回路滤波器。 | ||
| 搜索关键词： | 积分器 输出 降低 | ||
【主权项】：
暂无信息
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