[发明专利]利用单指令在多种模式中执行AES加密或解密有效
| 申请号： | 201410197191.5 | 申请日： | 2008-03-14 |
| 公开（公告）号： | CN103957100B | 公开（公告）日： | 2018-10-16 |
| 发明（设计）人： | M·狄克逊;S·陈努帕蒂;S·格伦 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | H04L9/06 | 分类号： | H04L9/06 |
| 代理公司： | 永新专利商标代理有限公司 72002 | 代理人： | 刘瑜;王英 |
| 地址： | 美国加*** | 国省代码： | 美国;US |
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| 摘要： | 一种用于执行加密的处理器，包括：解码器，用于对所述处理器接收到的指令进行解码；执行单元，用于执行所述指令；寄存器文件，其通过内部互连耦合至所述执行单元；所述执行单元包括密码电路，该密码电路用于响应于具有第一操作数和第二操作数、并可在多种加密模式中使用的单个加密指令，将明文值与第二值进行逻辑结合以产生一结合结果，并且使用高级加密标准(AES)算法和由第一隐式寄存器提供的密钥来对该结合结果进行加密以产生一加密结果，其中，所述第一操作数用于确定所述多种加密模式中的一种模式。 | ||
| 搜索关键词： | 利用 指令 多种 模式 执行 aes 加密 解密 | ||
【主权项】：
1.一种用于执行加密的处理器，包括：解码器，用于对所述处理器接收到的指令进行解码；执行单元，用于执行所述指令；寄存器文件，其通过内部互连耦合至所述执行单元；所述执行单元包括密码电路，所述密码电路用于响应于具有第一操作数和第二操作数、并可在多种加密模式中使用的单个加密指令，将从第一存储器中由计数器值指示的位置获得的所述第二操作数所提供的明文值与由第二寄存器提供的第二值进行逻辑结合以产生一结合结果，并且使用高级加密标准(AES)算法和由第一寄存器提供的密钥来对该结合结果进行加密以产生一加密结果，其中，所述第一操作数用于确定所述多种加密模式中的一种模式。
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