[实用新型]一种异步缓存器和集成电路有效
| 申请号： | 201320608667.0 | 申请日： | 2013-09-26 |
| 公开（公告）号： | CN203552238U | 公开（公告）日： | 2014-04-16 |
| 发明（设计）人： | 邵淑媛;黄雷 | 申请（专利权）人： | 快捷半导体(苏州)有限公司 |
| 主分类号： | G06F5/10 | 分类号： | G06F5/10 |
| 代理公司： | 北京派特恩知识产权代理事务所(普通合伙) 11270 | 代理人： | 武晨燕;张振伟 |
| 地址： | 215021 江*** | 国省代码： | 江苏;32 |
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| 摘要： | 本实用新型公开了一种异步缓存器，该异步缓存器为第一异步缓存器，所述第一异步缓存器的深度为小于第二异步缓存器的深度的任意偶数个地址块，所述任意偶数个地址块的编码为第二异步缓存器中间部分地址块的编码和虚拟地址块的编码；所述第一异步缓存器还包括：在读写数据过程中，按照读或写指针指示的地址块的编码确定第一异步缓存器的状态的状态指示器；本实用新型同时还公开了一种及集成电路，通过本实用新型的方案，能够使异步缓存器的深度更加符合需求，避免使用大深度异步缓存器时，浪费较多寻址空间，并且结构简单，易于电路实现，尽可能的减小了异步缓存器的尺寸，更加利于使用异步缓存器的设备的小型化。 | ||
| 搜索关键词： | 一种 异步 缓存 集成电路 | ||
【主权项】：
一种第一异步缓存器，其特征在于，该第一异步缓存器的深度为小于第二异步缓存器的深度的任意偶数个地址块，所述任意偶数个地址块的编码为第二异步缓存器中间部分地址块的编码和虚拟地址块的编码；所述第一异步缓存器还包括：在读写数据过程中，按照读或写指针指示的地址块的编码确定第一异步缓存器的状态的状态指示器。
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