[发明专利]基于分块渲染的GPU中多管线渲染的实现方法有效
申请号: | 201210287875.5 | 申请日: | 2012-08-14 |
公开(公告)号: | CN102819820A | 公开(公告)日: | 2012-12-12 |
发明(设计)人: | 焦永 | 申请(专利权)人: | 长沙景嘉微电子股份有限公司 |
主分类号: | G06T1/60 | 分类号: | G06T1/60 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 410205 湖南*** | 国省代码: | 湖南;43 |
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摘要: | 本发明公开了一种基于分块渲染的GPU中多管线渲染的实现方法。它包括绘图命令解析,2D绘图模块—完成2D清屏、点阵字等功能,图元管理—完成图元顶点及属性的获取,几何变换/光照,裁剪,屏幕坐标变换,图元分块,M条光栅化管线,M条Z/Stencil测试管线,M条纹理映射管线,M条融合管线,图形显示等模块。该实现结构通过资源复制实现了分块渲染的性能加速目的。 | ||
搜索关键词: | 基于 分块 渲染 gpu 管线 实现 方法 | ||
【主权项】:
基于分块渲染的GPU中多管线渲染的实现方法,其特征为:软件通过PCI总线向GPU硬件发送绘图命令和参数配置命令,GPU收到命令进入命令解析模块,按照图元类型从DDR读取图元顶点并组织成相应图元的数据进入几何变换/光照、裁剪、屏幕坐标转换模块,然后按照定义的分块大小(如32×32像素为一块)将图元分块,为了使分块和绘制并行工作,维持两个计数器—采用2个RAM分别记录两帧图像的每块的图元数目,每一个块在DDR中都有一个固定的读写起始地址和固定的存储空间,将分块后的图元数据按照图元所属的块写入相应的DDR地址,一帧内的所有图元都写入DDR之后,按照块的顺序将DDR中的块内的待绘制数据取出,进入光栅化过程,为实现多管线的绘制,可以设计M个光栅化管线,按照管线0绘制块号为0,M,2M,3M,……,nM的块;管线1绘制块号为1,M+1,2M+1,3M+1,……,nM+1的块;管线2绘制块号为2,M+2,2M+2,3M+2,……,nM+2的块;……;管线M‑1绘制块号为M‑1,2M‑1,3M‑1,……,(n+1)M‑1的块。
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