[发明专利]高速分频器及使用高速分频器的锁相环路有效
| 申请号： | 201180036257.7 | 申请日： | 2011-08-09 |
| 公开（公告）号： | CN103026627A | 公开（公告）日： | 2013-04-03 |
| 发明（设计）人： | 卡西克·苏布拉杰;丹亚·K | 申请（专利权）人： | 德州仪器公司 |
| 主分类号： | H03K23/64 | 分类号： | H03K23/64;H03L7/18 |
| 代理公司： | 北京律盟知识产权代理有限责任公司 11287 | 代理人： | 王璐 |
| 地址： | 美国德*** | 国省代码： | 美国;US |
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| 摘要： | 一种分频器(200)包括最低有效LS级(220)、多个经级联除法器级(230-1到230-N)及输出级(210)。所述LS级(220)接收输入信号(201)、程序位及第一模式信号，且产生第一经分频信号及输出模式信号。所述多个除法器级(230-1到230-N)中的每一者将紧邻的前一级的输出的频率除以由对应程序位及对应模式信号指定的值。所述多个除法器级中的第一除法器级(230-1)经耦合以接收所述第一经分频信号且产生所述第一模式信号。所述输出级(210)接收所述输出模式信号及控制信号，且在所述控制信号处于1逻辑电平的情况下通过将所述输出模式信号的频率除以2来产生输出信号(299)。否则，所述输出级在不分频的情况下转发所述输出模式信号。 | ||
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【主权项】：
一种分频器，其包含：最低有效级，其经耦合以接收第一输入信号、第一程序位及第一输入模式信号，且产生第一经分频信号及第一输出模式信号，其中所述第一输入模式信号及所述第一程序位指定将由所述最低有效级使用的分频模式；多个较高有效性除法器级，其以级联方式耦合，其中所述多个较高有效性除法器级中的每一者将紧邻的前一级的输出的频率除以由对应程序位及对应输入模式信号指定的值，其中所述多个较高有效性除法器级包括第一除法器级，其中所述第一除法器级经耦合以接收所述第一经分频信号且产生所述第一输入模式信号；及输出级，其用以接收所述第一输出模式信号及模式位，且产生第一输出信号，其中在所述模式位处于1逻辑电平的情况下，所述输出级通过将所述第一输出模式信号的频率除以2来产生所述第一输出信号，否则所述输出级转发所述输出模式信号作为所述第一输出信号。
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