[发明专利]一种FPGA用基于PCIe的集成化逻辑分析模块有效
| 申请号： | 201110371556.8 | 申请日： | 2011-11-21 |
| 公开（公告）号： | CN102495920A | 公开（公告）日： | 2012-06-13 |
| 发明（设计）人： | 陈庚 | 申请（专利权）人： | 南京中兴特种软件有限责任公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 南京天华专利代理有限责任公司 32218 | 代理人： | 夏平 |
| 地址： | 210012 江苏*** | 国省代码： | 江苏;32 |
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| 摘要： | 一种FPGA用基于PCIe的集成化逻辑分析模块，它包括触发控制器、DMA控制器、报文发送引擎、报文接收引擎和PCIe收发控制器。本发明不仅可以实现SignalTap或ChipScope的所有功能，还可以解决大型设计中BlockRAM余量不够用的情况，因为此时数据不是存在芯片内部而是导出到CPU侧的内存中，只要内存允许便可以采集足够量的数据。另外，由于触发模块是寄存器级代码，那么可以通过修改这里的代码来实现更为复杂的触发设置，远比SignalTap或ChipScope灵活得多。在大型设计中，CPU、FPGA共存于一个系统很常见，而PCIe链路又是很多高速系统常用通道，因此本方案的适用场合广泛。 | ||
| 搜索关键词： | 一种 fpga 基于 pcie 集成化 逻辑 分析 模块 | ||
【主权项】：
一种FPGA用基于PCIe的集成化逻辑分析模块，其特征是它包括触发控制器、DMA控制器、报文发送引擎、报文接收引擎和PCIe收发控制器，所述的PCIe收发控制器作为逻辑分析模块的控制信号输入端连接逻辑分析模块所在产品系统的CPU，PCIe收发控制器的控制信号输出端连接报文接收引擎的控制信号输入端，报文接收引擎的一控制信号输出端连接DMA控制器的一对应控制信号输入端，另一控制信号输出端连接触发控制器的控制信号输入端，触发控制器作为逻辑分析模块的逻辑数据输入端采集设计实体模块的触发条件的逻辑数据，触发控制器的控制信号输出端连接DMA控制器的对应控制信号输入端，DMA控制器的控制信号端与报文发送引擎双向连接，报文发送引擎的逻辑数据输入端连接设计实体模块的对应逻辑数据输出端，报文发送引擎的逻辑数据输出通过PCIe收发控制器输出至逻辑分析模块所在产品系统的CPU。
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