[发明专利]连续时间的高速低功耗sigma-delta调制器无效

专利信息
申请号: 201010246362.0 申请日: 2010-08-05
公开(公告)号: CN101917198A 公开(公告)日: 2010-12-15
发明(设计)人: 李冉;张翼;李婧;洪志良 申请(专利权)人: 复旦大学
主分类号: H03M3/02 分类号: H03M3/02
代理公司: 上海正旦专利代理有限公司 31200 代理人: 陆飞;盛志范
地址: 20043*** 国省代码: 上海;31
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摘要: 发明属于集成电路设计技术领域,具体为一种连续时间的高速低功耗sigma-delta调制器。该调制器由环路滤波器、内部量化器和反馈数模转换器构成。其中调制器采用四阶有源RC滤波器结构,采用分布式前馈和谐振子反馈方式,内部采用四位量化。采用负反馈的方法减小了反馈电阻的大小避免了版图的浪费和过大寄生参数的引入。本发明sigma-delta调制器可以在1~1.2V电源电压条件下将连续的模拟信号输入转化离散的数字信号输出。其带宽可以达到20MHz,精度达到11.5位,可以满足下一代无限通信协议LTE的最大带宽要求。
搜索关键词: 连续 时间 高速 功耗 sigma delta 调制器
【主权项】:
一种连续时间的高速低功耗sigma delta调制器,其特征在于由环路滤波器、内部量化器和反馈数模转换器构成;即该Sigma Delta调制器中,环路滤波器采用四阶有源RC滤波器结构,并采用分布式前馈和谐振子反馈方式,内部采用四位量化;所述四阶有源RC滤波器中,第一级到第四级积分器依次串联连接,它们的增益系数分别为k1~k4,四位量化器连接在第四级积分器的输出和第一半周期延迟器D1之间,反馈DAC1、DAC2和DAC3均为非自归零波形输出,反馈DAC1连接在第一半周期延迟器D1的输出端和第一级积分器的输入端之间,反馈DAC2连接在第一半周期延迟器D1的输出端和第四级积分器完成信号加法的输入端之间,反馈DAC3连接在第二半周期延迟器D2的输出端和第四级积分器完成信号加法的输入端之间,第一半周期延迟器D1连接在四位量化器输出端和反馈DAC1的输入端之间,第二半周期延迟器D2连接在第一半周期延迟器D1的输出端和反馈DAC3的输入端之间,前馈系数f1连接在第一级积分器输出端和第四级积分器输入端之间,前馈系数f2连接在第二级积分器输出端和第四级积分器输入端之间,前馈系数f3连接在第三级积分器输出端和第四级积分器输入端之间,谐振反馈系数g1连接在第二级积分器输出端和第一级积分器输入端之间,谐振反馈系数g2连接在第四级积分器输出端和第三级积分器输入端之间。
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