[发明专利]用于高效FFT和FIR硬件加速器的计算模块有效
| 申请号： | 200980139643.1 | 申请日： | 2009-08-04 |
| 公开（公告）号： | CN102171682A | 公开（公告）日： | 2011-08-31 |
| 发明（设计）人： | B·勒纳 | 申请（专利权）人： | 美国亚德诺半导体公司 |
| 主分类号： | G06F17/14 | 分类号： | G06F17/14 |
| 代理公司： | 北京泛华伟业知识产权代理有限公司 11280 | 代理人： | 王勇 |
| 地址： | 美国马*** | 国省代码： | 美国;US |
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| 摘要： | 一种可运行在FFT模式和FIR模式的硬件加速器。硬件加速器可接收输入数据和系数数据并为所选择的模式执行计算。在FFT模式，计算基2FFT，产生对应于两个复数四个实数输出。在FIR模式，产生一个实数输出。硬件加速器可使用三个复用器从FFT模式向FIR模式转换。所有FIR组件可以在FFT模式中使用。可以增加寄存器来提供流水线操作支持。硬件加速器可以支持多个数值表示系统。 | ||
| 搜索关键词： | 用于 高效 fft fir 硬件 加速器 计算 模块 | ||
【主权项】：
一种硬件加速器，包括：多个数值输入端，用于接收数值；主逻辑运算单元，被配置为输出中间值和第一结果，所述第一结果是通过收到第一模式信号时对数值求第一代数表达式的值以及收到第二模式信号时求第二代数表达式的值来确定的；第二逻辑运算单元，被配置为输出第二结果，所述第二结果是通过对中间值求第三代数表达式的值来确定的。
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