[发明专利]模拟/数字控制延迟锁定回路无效
申请号: | 200910151743.8 | 申请日: | 2006-08-16 |
公开(公告)号: | CN101697487A | 公开(公告)日: | 2010-04-21 |
发明(设计)人: | 金龙珠 | 申请(专利权)人: | 海力士半导体有限公司 |
主分类号: | H03L7/08 | 分类号: | H03L7/08;G11C11/401 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 钱大勇 |
地址: | 韩国*** | 国省代码: | 韩国;KR |
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摘要: | 本发明提供模拟/数字控制延迟锁定回路(DLL)。该DLL包括:相位检测器,其用于接收输入时钟信号及反馈信号,并检测该两个信号之间的相位差,以提供向上检测信号及向下检测信号中之一;电荷泵,其用于接收该向上检测信号及向下检测信号中之一,并基于这些信号产生经调整的输出电流;回路滤波器,其用于对该输出电流进行低通滤波,以产生模拟控制电压;电压控制延迟线(VCDL),其用于接收该模拟控制电压、输入时钟信号及数字码,并基于该模拟控制电压及数字码来延迟该输入时钟信号,以产生输出时钟信号;延迟拷贝模型化单元,其由延迟因子的拷贝形成,且用于接收该输出时钟信号并产生该反馈信号;及数字码产生器,其用于产生数字码。 | ||
搜索关键词: | 模拟 数字控制 延迟 锁定 回路 | ||
【主权项】:
一种模拟/数字控制延迟锁定回路(DLL),其包含:相位检测器,其用于接收输入时钟信号及反馈信号,并检测该两个信号之间的相位差,以提供向上检测信号及向下检测信号中之一;电荷泵,其用于接收该向上检测信号及向下检测信号中之一,并基于这些信号产生经调整的输出电流;回路滤波器,其用于对该输出电流进行低通滤波,以产生模拟控制电压;电压控制延迟线(VCDL),其用于接收该模拟控制电压、输入时钟信号及数字码,并基于该模拟控制电压及数字码来延迟该输入时钟信号,以产生输出时钟信号;延迟拷贝模型化单元,其由延迟因子的拷贝形成,且用于接收该输出时钟信号并产生该反馈信号;及数字码产生器,其用于产生数字码。
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