[发明专利]一种训练序列构造及其OFDM时间同步方法无效
申请号: | 200910141434.2 | 申请日: | 2009-05-09 |
公开(公告)号: | CN101883069A | 公开(公告)日: | 2010-11-10 |
发明(设计)人: | 罗仁泽;高頔;伍晓琼;刘盈;黄家盛 | 申请(专利权)人: | 电子科技大学中山学院 |
主分类号: | H04L27/26 | 分类号: | H04L27/26 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 528402 *** | 国省代码: | 广东;44 |
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摘要: | 本发明目提供一种新的OFDM时间同步方法,通过设计训练序列结构及其相应的同步算法增强时间同步的相关性能。本发明所述的OFDM同步训练序列采用叠加在传输数据循环前缀上的方法,不增加额外的传输开销,由于训练序列中插入了0,进一步降低了训练序列与传输数据之间的干扰。 | ||
搜索关键词: | 一种 训练 序列 构造 及其 ofdm 时间 同步 方法 | ||
【主权项】:
一种训练序列构造及其OFDM时间同步方法,其特征在于,该方法包括如下步骤:步骤1确定发送数据的帧结构,确定循环前缀的长度、训练序列的长度L,L通常等于循环前缀的长度;步骤2选择长度为L/4的编码序列,编码类型一般选择自相关性能优异的、长度小于等于L/4的码,如果L/4比所选择的码长,则以0充填码的后位;步骤3将步骤2中的编码序列取共轭,得到一个新的编码序列;步骤4将步骤2中所述的编码序列后面添加长度为L/4的全0序列,再将步骤3中得到的新序列放在该全0序列后,在步骤3所述的全新序列后面再添加长度为L/4的全0序列,至此构成训练序列m[k];步骤5将步骤4中得到的训练序列叠加在一个发送数据的循环前缀上;步骤6时间同步:将经过信道的数据进行相关运算,其同步信号可以通过数学表达式得: γ [ n ] = Σ k = 0 L - 1 r [ n - k ] gm * [ k ] 其中,r[k]为接收信号,m[k]为已知的训练序列,L为训练序列的长度,一般等于循环前缀的长度,*为取共轭运算,n为接收序列相对本地训练序列对齐时的滑动点数;在滑动窗内找到相关结果的最大值,并确定最大值所对应接收数据的位置,至此时间同步过程完成。
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