[发明专利]设计时钟域中锁存器的布图的方法和计算机系统有效
| 申请号： | 200710169914.0 | 申请日： | 2007-11-08 |
| 公开（公告）号： | CN101206686A | 公开（公告）日： | 2008-06-25 |
| 发明（设计）人： | C·N·塞;S·拉姆吉;C·J·阿尔珀特;P·G·维利亚卢比亚 | 申请（专利权）人： | 国际商业机器公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 北京市中咨律师事务所 | 代理人： | 于静;李峥 |
| 地址： | 美国*** | 国省代码： | 美国;US |
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| 摘要： | 一种设计时钟域中锁存器的布图的方法和计算机系统，其中通过增加吸引力逐步牵引锁存器直到其最终与时钟分布结构例如局部时钟缓冲器(LCB)相邻。在迭代时，调用时序优化，例如栅极尺寸调整和再缓冲，以保持时间估计准确。通过施加迭代时钟网络加权调整，本发明使逻辑布局和时钟布局之间的相互作用更强，这一点可产生更高质量的时序并且大大节省功率。 | ||
| 搜索关键词： | 设计 时钟 域中 锁存器 方法 计算机系统 | ||
【主权项】：
1.一种设计集成电路的时钟域中的多个锁存器的布图的方法，包括：基于时序约束优化所述锁存器的输入布图，以产生中间优化布图；基于所述中间优化布图限定所述时钟域的时钟分布结构的位置；基于吸引值将所述锁存器布局在所述时钟分布结构周围，以产生新的输入布图；以及迭代地重复所述优化、限定、以及布局，同时逐次地增加所述吸引值。
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