[发明专利]去交织器和双维特比解码器结构无效
| 申请号： | 200680034682.1 | 申请日： | 2006-07-21 |
| 公开（公告）号： | CN101268452A | 公开（公告）日： | 2008-09-17 |
| 发明（设计）人： | M·阿尔腾塔什;T·艾图尔;R·H·马哈德帕;F·史;S·坦恩布林克;R·颜 | 申请（专利权）人： | 伟俄内克斯研究公司 |
| 主分类号： | G06F13/00 | 分类号： | G06F13/00 |
| 代理公司： | 北京纪凯知识产权代理有限公司 | 代理人： | 赵蓉民 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 一对并行维特比解码器使用窗口块式数据以320兆比特每秒以上的速率解码数据。给所述解码器输送数据的去交织器的存储体运行，使一些存储体接收数据而其他存储体发送数据给所述解码器。每对解码器的并行输入流重叠所述解码器的几个回溯长度，致使在输入流的末端输入到第一解码器的数据与在输入流的开头输入到同一对解码器的第二解码器的数据相同。然后，所述第一解码器能够将其路径量度与所述第二解码器后期同步，而所述第二解码器能够将其路径量度与所述第一解码器预同步。所述去交织器数据长度是回溯长度的整数倍，或只有输入到第一交织器第一块的数据被填充。 | ||
| 搜索关键词： | 交织 双维特 解码器 结构 | ||
【主权项】：
1.一个去交织器和解码器系统，包括：用于去交织数据的去交织器，所述去交织器包括用于存储去交织数据的多个存储体；和用于解码所述去交织数据的多个维特比解码器，所述维特比解码器每个被配置成在分开的时间访问单独的存储体，其中每个维特比解码器采取的用于解码所述去交织数据的解码步骤数目等于以比特计的所述去交织器的数据长度。
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