[发明专利]具有突发读取等待功能的与非型快闪存储装置无效
| 申请号： | 200610151532.0 | 申请日： | 2006-09-11 |
| 公开（公告）号： | CN1933028A | 公开（公告）日： | 2007-03-21 |
| 发明（设计）人： | 黄相元 | 申请（专利权）人： | 三星电子株式会社 |
| 主分类号： | G11C16/06 | 分类号： | G11C16/06;G11C16/32;G11C11/56 |
| 代理公司： | 北京市柳沈律师事务所 | 代理人： | 钱大勇;蒲迈文 |
| 地址： | 韩国*** | 国省代码： | 韩国;KR |
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| 摘要： | 一种NAND快闪存储装置，可以包括接口块，用于在读取操作期间接收外部读取使能信号，以输出内部时钟信号。该NAND快闪存储装置也可以包括缓冲器时钟控制电路，用于响应于数据输出使能信号和内部时钟信号而工作。该NAND快闪存储装置还可以包括缓冲器时钟生成电路，用于接收内部时钟信号并根据缓冲器时钟控制电路的控制输出而生成第一和第二缓冲器时钟信号。该NAND快闪存储装置还可以包括数据输出缓冲器电路，用于响应于第一和第二缓冲器时钟信号中的一个而依次输出所读取的数据，其中，当数据输出使能信号被激活时，所述缓冲器时钟控制电路控制缓冲器时钟生成电路生成具有单个脉冲的第二缓冲器时钟信号。 | ||
| 搜索关键词： | 具有 突发 读取 等待 功能 非型快 闪存 装置 | ||
【主权项】：
1.一种NAND快闪存储装置，包括：接口块，用于在读取操作期间接收外部读取使能信号，以输出内部时钟信号；缓冲器时钟控制电路，用于响应于数据输出使能信号和内部时钟信号而工作；缓冲器时钟生成电路，用于接收内部时钟信号并根据缓冲器时钟控制电路的控制输出而生成第一和第二缓冲器时钟信号；数据输出缓冲器电路，用于响应于第一和第二缓冲器时钟信号中的一个而依次输出所读取的数据，其中，当数据输出使能信号被激活时，所述缓冲器时钟控制电路控制所述缓冲器时钟生成电路生成具有单个脉冲的第二缓冲器时钟信号。
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