[发明专利]常温下构筑高密度均匀分布硅纳米点、纳米线的方法无效
申请号: | 200610085300.X | 申请日: | 2006-06-09 |
公开(公告)号: | CN1873923A | 公开(公告)日: | 2006-12-06 |
发明(设计)人: | 徐岭;徐骏;马忠元;黄信凡;陈坤基;李伟;李卫;赵伟明;孙萍 | 申请(专利权)人: | 南京大学 |
主分类号: | H01L21/30 | 分类号: | H01L21/30;B82B3/00;C01B33/02 |
代理公司: | 南京苏科专利代理有限责任公司 | 代理人: | 何朝旭 |
地址: | 210093江*** | 国省代码: | 江苏;32 |
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摘要: | 本发明涉及一种常温下用硅衬底上的单层CdTe纳米晶体作为掩模版,构筑高密度均匀分布硅纳米点、纳米线的方法,属于纳米电子和纳米光电子器件材料技术领域。该方法包括1)、氧化、刻蚀;2)、铺设单层CdTe纳米晶体模版;3)、反应离子刻蚀;4)、去除模版和漂洗;5)、退火、钝化各步骤,完成高密度均匀分布硅纳米点、纳米线的构筑。采用本发明的方法后,可以与当前微电子工艺技术相兼容,避免使用成本昂贵的超精细加工技术,在获得均匀分布的高密度纳米硅的同时,可对纳米晶粒表面进行有效钝化,以降低缺陷态密度,因而能够显现出由于尺寸变化而引起的量子效应,达到调控低维有序体系结构和性能的目的,使纳米硅量子点走出实验室,切实实现产业化。 | ||
搜索关键词: | 常温 构筑 高密度 均匀分布 纳米 方法 | ||
【主权项】:
1.一种常温下构筑高密度均匀分布硅纳米点、纳米线的方法,包括以下步骤:1)、氧化、刻蚀——在晶体硅表面干氧氧化,形成厚度为500-1000纳米的SiO2薄膜,接着在Si/SiO2衬底上进行光刻,露出需制备纳米硅的区域;2)、铺设模版——将Si/SiO2衬底放到PDDA溶液中充分浸泡,再用去离子水洗去表面的残余PDDA分子;之后把附着有一层PDDA分子的硅衬底浸泡到CdTe纳米晶体水溶液中,使正负离子静电相互作用,在硅衬底的表面吸附单层密堆排列的CdTe纳米晶体膜;3)、反应离子刻蚀——用附在Si/SiO2衬底上的单层CdTe纳米晶体膜作为掩模版,采用四氟化碳气体对硅衬底进行反应离子刻蚀,在需制备纳米硅区域形成纳米点或纳米线阵列;4)、去除模版、漂洗——将反应离子刻蚀后的硅衬底放入盐酸中浸泡,去除Si和SiO2表面的CdTe纳米晶体,漂洗后得到图形化的硅纳米点或纳米线阵列;5)、退火、钝化——将去除模版后的硅衬底高温退火,使硅纳米点或纳米线阵列的外表面缺陷被SiO2钝化。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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