[发明专利]动态逻辑暂存器以及动态暂存输出信号的方法有效
| 申请号： | 200510090699.6 | 申请日： | 2005-08-18 |
| 公开（公告）号： | CN1731679A | 公开（公告）日： | 2006-02-08 |
| 发明（设计）人： | 伊慕兰·库瑞希;詹姆士·R·蓝德博格 | 申请（专利权）人： | 威盛电子股份有限公司 |
| 主分类号： | H03K19/173 | 分类号： | H03K19/173 |
| 代理公司： | 北京中原华和知识产权代理有限责任公司 | 代理人： | 寿宁;张华辉 |
| 地址： | 中国*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 一种动态逻辑暂存器，包括：一运算元件互补对，一延迟反向逻辑电路，一动态计算器，一闩锁逻辑电路，和一耦接至输出端的维持电路。该运算元件互补对是对应于一时脉信号且提供一预充电节点和一运算节点。该延迟反向逻辑电路输出一由时脉信号延迟反向而成的完成信号。该动态计算器耦接在该预充电节点和该运算节点之间，用以在该时脉与完成信号操作边缘间的运算期间中，依据一数据信号来计算一逻辑函数。该闩锁逻辑电路在运算期间中使一输出节点的状态可由该预充电节点的状态来决定，此外，需箝住该预充电节点以防止数据信号的波动传送至该输出节点。 | ||
| 搜索关键词： | 动态 逻辑 暂存器 以及 暂存 输出 信号 方法 | ||
【主权项】：
1、一种动态逻辑暂存器，其特征在于其包括：一运算元件互补对，对应于一时脉信号且提供一预充电节点和一运算节点；一延迟反向逻辑电路，用以接收该时脉信号且输出一由该时脉信号延迟与反向而成的完成信号；一动态计算器，其耦接在预充电节点和该运算节点之间，在一该时脉信号的运作边缘和该完成信号的下一边缘之间的运算期间中，根据至少一输入数据信号来运算一逻辑函数；一闩锁逻辑电路，对应于该时脉信号、该完成信号以及该预充电节点的状态，是在该运算期间中使一输出节点的状态可由该预充电节点的状态来决定，箝住该预充电节点以防止至少一数据信号的波动传送至该输出节点；以及一维持电路，其耦接至该输出节点。
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