[发明专利]非易失性存储设备无效
申请号: | 200510054740.4 | 申请日: | 2005-03-11 |
公开(公告)号: | CN1677571A | 公开(公告)日: | 2005-10-05 |
发明(设计)人: | 白石敦;四方淳史;中村靖宏;小昌诚 | 申请(专利权)人: | 株式会社瑞萨科技 |
主分类号: | G11C16/06 | 分类号: | G11C16/06;G06F12/16 |
代理公司: | 永新专利商标代理有限公司 | 代理人: | 韩宏 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | 本发明涉及抑制由重写处理期间的断电造成的数据丢失,并涉及缩短进行耗尽检查所需的时间。一种非易失性存储设备包括可重写非易失性存储器和卡控制器。该非易失性存储器具有与逻辑地址相对应的物理地址区和保存区。响应于对所需逻辑地址的数据重写指令,卡控制器将与该逻辑地址相对应的预定物理地址区中的数据存储到保存区,并重写该物理地址区中存储的数据。当物理地址区的重写不完全时,卡控制器利用保存区中存储的数据来重写物理地址区中的数据。因而,利用数据备份可以抑制由断电造成的数据丢失,并且足以在保存区和物理地址区这两个地方进行耗尽检查。 | ||
搜索关键词: | 非易失性 存储 设备 | ||
【主权项】:
1.一种非易失性存储设备,包括:电可重写非易失性存储器;以及卡控制器,用于执行存储器控制和外部接口控制,其中,所述非易失性存储器包括具有多个存储单元的非易失性存储部分,所述非易失性存储部分包括作为非易失性存储区的物理地址区和保存区,该物理地址区的每一个都与一逻辑地址相对应;该保存区用于保存在所述物理地址区的任意之一中存储的数据,其中,在响应于从其外部收到的对所需逻辑地址的数据写指令的第一存取中,所述卡控制器将与所述所需逻辑地址相对应的第一物理地址区中存储的第一数据存储到所述保存区,并将第二数据写入所述第一物理地址区中,以及其中,当在与响应于所述数据写指令的所述第一存取不同的对所述第一物理地址区的存取中,检测到所述第一物理地址区的写不完全时,所述卡控制器执行把所述保存区中存储的所述第一数据写到所述第一物理地址区的控制。
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