[实用新型]显示器图像A/D转换取样时钟相位的自动校正电路无效

专利信息
申请号: 03216706.7 申请日: 2003-04-22
公开(公告)号: CN2613018Y 公开(公告)日: 2004-04-21
发明(设计)人: 刘志恒;战嘉瑾;丁勇;陈永强;何云鹏;缪建兵 申请(专利权)人: 海信集团有限公司
主分类号: G09G5/00 分类号: G09G5/00;G06T1/00
代理公司: 青岛联智专利商标事务所有限公司 代理人: 宫乃斌
地址: 266071*** 国省代码: 山东;37
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摘要: 一种显示器图像A/D转换取样时钟相位的自动校正电路,属于显示器技术。它包括输入经A/D转换后的RGB灰度值把相临点数据相减并延时得到三相临点的斜率的减法模块,与减法模块连接将上述三相临点的斜率数据进行比较与逻辑运算得到累加使能信号(acc-en)的逻辑电路,与逻辑电路连接当累加使能信号acc-en为真时对slope-mid执行累加操作的累加器。减法模块包括把相临点数据相减并延时得到三相临点的斜率的加法器和与加法器依次连接进行逻辑处理的D触发器。它能自动调整A/D转换的取样时钟相位,使取样点最合理,达到最佳的取样效果,有效改善经A/D转换后的数字图像的质量。可广泛应用于各种显示器的图像处理中。
搜索关键词: 显示器 图像 转换 取样 时钟 相位 自动 校正 电路
【主权项】:
1.一种显示器图像A/D转换取样时钟相位的自动校正电路,其特征在于它至少包括输入经A/D转换后的RGB灰度值把相临点数据相减并延时得到三相临点的斜率(slope-pre、slope-mid和slope-cur)的减法模块,与减法模块连接将上述三相临点的斜率数据进行比较与逻辑运算得到累加使能信号(acc-en)的逻辑电路,与逻辑电路连接当累加使能信号acc-en为真时对slope-mid执行累加操作的累加器。
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