[发明专利]用于级联码解码的高速模块、装置和方法有效
| 申请号： | 01820410.4 | 申请日： | 2001-11-09 |
| 公开（公告）号： | CN1479975A | 公开（公告）日： | 2004-03-03 |
| 发明（设计）人： | 帕特里克·埃达;拉米施·匹恩迪阿 | 申请（专利权）人： | 法国电信公司;恩斯特布列塔尼电信大学集团公司 |
| 主分类号： | H03M13/29 | 分类号： | H03M13/29 |
| 代理公司： | 中国国际贸易促进委员会专利商标事务所 | 代理人： | 李强 |
| 地址： | 法国*** | 国省代码： | 法国;FR |
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| 摘要： | 本发明涉及用于对一个对应于至少两个基本码C1和C2的级联码进行解码的模块，它采用其中存储要被解码的数据的存储装置(81、83、90、111、113)，该模块包括用于至少一个基本码的至少两个基本解码器(821、822、82m)，与一个基本码相联系的多个基本解码器并行地同时处理包含在存储装置中的多个独立的码字。 | ||
| 搜索关键词： | 用于 级联 解码 高速 模块 装置 方法 | ||
【主权项】：
1.用于对一个对应至少两个基本码的级联码进行解码的模块，提供其中存储要被解码的数据样值的存储装置，其特征在于，对于上述基本码中的至少一个，它包括至少两个基本解码器(821至82m，1121至112m)，与一个上述基本码相关的上述基本码器(821至82m，1121至112m)并行地同时执行对包含在上述存储装置(81、83、90、111、113)中的不同码字的处理，并且其中上述存储装置(81、83、90、111、113)以舱室(105)进行组织，每个舱室具有单个地址，并且每个舱室包含至少两段对应于一个基本码字的基本数据(101、102、103、104)。
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