[发明专利]流水线微处理器的循环高速缓冲存储器及高速缓存控制器有效
| 申请号： | 01121139.3 | 申请日： | 2001-05-31 |
| 公开（公告）号： | CN1329302A | 公开（公告）日： | 2002-01-02 |
| 发明（设计）人： | R·H·斯凯尔斯 | 申请（专利权）人： | 德克萨斯仪器股份有限公司 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38;G06F11/00 |
| 代理公司： | 上海专利商标事务所 | 代理人： | 沈昭坤 |
| 地址： | 美国得*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明揭示一种微处理器和用于操作该微处理器的方法。该微处理器包括从一个指令流水线接收指令的多重执行单元,一个循环高速缓存存储器(210)与指令流水线通信,一个循环高速缓存控制器(214)控制指令流。最好由软件指令通知存控制器开始建立一个规定规模的软件流水线循环到缓存器。然后将指令从指令流水线累积到缓存器;当软件流水线循环的核心被建立到缓存器时,控制器最好停顿该指令流水线并使用缓存的指令执行循环。在循环完成后,恢复指令流水线。可减少所需的程序规模并减少功率消耗。 | ||
| 搜索关键词： | 流水线 微处理器 循环 高速 缓冲存储器 高速缓存 控制器 | ||
【主权项】：
权利要求书1.一种操作具有指令流水线和一个能储存N个执行包的循环高速缓存存储器的多重执行单元处理器的方法，其中N是大于零的整数，其特征在于，所述的方法包括下述步骤：提供一个用于储存N个执行包的循环高速缓存存储器，其中N是一个大于零的整数；在所述循环高速缓存存储器中建立一个长度为n个执行包的软件流水线循环核心，其中n为大于零且小于或等于N的整数；停顿所述的指令流水线；通过对每次迭代发送所述循环高速缓存存储器中的n个执行包的所述软件流水线循环核心，执行所述软件流水线循环核心的至少一次迭代；检测循环退出条件；和恢复所述的指令流水线。
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