[发明专利]数模变换器及方法,数据插值装置及方法无效

专利信息
申请号: 00807032.6 申请日: 2000-06-19
公开(公告)号: CN1154233C 公开(公告)日: 2004-06-16
发明(设计)人: 小柳裕喜生 申请(专利权)人: 酒井康江
主分类号: H03M3/00 分类号: H03M3/00
代理公司: 中国专利代理(香港)有限公司 代理人: 刘宗杰;叶恺东
地址: 日本*** 国省代码: 日本;JP
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摘要: 发明的目的在于提供运算量少,能够缩小电路规模的数字-模拟变换器及方法,数据插值装置及方法。设置根据输入的离散数据的值分别生成基本波形的数字波形发生单元(10);对于数字波形发生单元(10)的输出进行过速率抽样以及卷积运算等的卷积运算单元(20);把卷积运算单元(20)的输出进行D/A变换的D/A变换单元(30),根据离散数据把基本数字波形进行振幅调制的同时通过卷积运算等进行合成,然后仅进行过速率抽样和卷积运算的就可以得到连续的插值值。
搜索关键词: 数模 变换器 方法 数据 装置
【主权项】:
1.一种数-模变换器,其特征在于具备:合成装置,具备顺序地使与上述基准频率同步顺序输入的离散数据各延迟上述基准频率时钟部分的n个延迟装置;和对于从上述n个延迟装置输出的各个数据值,分别乘入对应于基准数字波形的各个增益值的同时,把各个相乘结果相加的乘加装置;过速率抽样装置,遍及多级进行对于由上述合成装置生成的数字数据,与前一级相比较以2倍的频率时钟把所输入的各数据值抽样,把所得到的各数据值与把这些数据值各移动半个时钟部分的各数据值分别相加后输出到下一级处理;运算装置,具备把由上述过速率抽样装置得到的数字数据顺序各延迟上述过速率抽样装置最末级的时钟频率的多个延迟装置;把来自上述多个延迟装置的输出分别相加后输出的加法装置;和D/A变换装置,把由上述运算装置求出的各数据值变换为模拟量。
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