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[发明专利]基于请求类型的选择性后置数据错误检测-CN201310567563.4有效
发明人： R·A·格诺尼;J·S·多德森;G·L·格思里;W·J·斯塔克;J·A·施蒂切利 -专利权人：国际商业机器公司
申请日： 2013-11-14 - 公布日： 2017-06-27 - 主分类号： G06F11/00 文献下载
摘要：在一种数据处理系统中，至少基于存储器访问请求的访问类型在相对于对存储器访问请求的目标存储器块完成错误检测处理而言的数据传输的至少第一定时与第二定时之间进行选择。响应于接收存储器访问请求并且选择第一定时，在对目标存储器块完成错误检测处理之前向请求器传输来自目标存储器块的数据。响应于接收存储器访问请求并且选择第二定时，在对目标存储器块完成错误检测处理之后并且响应于对目标存储器块完成错误检测处理向请求器传输来自目标存储器块的数据。
基于请求类型选择性后置数据错误检测

[发明专利]用于附接处理器的可编程一致代理-CN201310594979.5有效
发明人： B·布拉纳;D·W·卡明斯;M·S·西格尔;W·J·斯塔克;J·A·施蒂切利 -专利权人：国际商业机器公司
申请日： 2013-11-21 - 公布日： 2017-05-31 - 主分类号： G06F9/44 文献下载
摘要：主要一致系统内的一致附接处理器代理（CAPP）代表附接处理器（AP）参与主要一致系统的系统构造上的操作，该AP在主要一致系统的外部，并且耦接至CAPP。操作包括与CAPP通信的、包括请求和至少一个一致性消息的多个组件。CAPP通过参考可以重新编程的CAPP内的至少一个可编程数据结构来确定操作的组件中的一个或多个组件。
用于处理器可编程一致代理

[发明专利]在数据处理系统中用于执行浮点算术运算的方法和装置-CN201280061198.3有效
发明人： J·A·施蒂切利;E·E·雷特尔;K·拉加玛尼;B·梅利;J·B·卡特 -专利权人：国际商业机器公司
申请日： 2012-11-21 - 公布日： 2016-10-12 - 主分类号： G06F7/76 文献下载
摘要：提供用于在数据处理系统中执行浮点算术运算的机制。接收浮点算术运算的多个浮点操作数，并且对多个浮点操作数中的至少一个浮点操作数的尾数中的位进行移位。尾数中被移位到至少一个浮点操作数的尾数的位范围以外的一个或者多个位被存储，并且基于所存储的、该尾数中被移位到至少一个浮点操作数的尾数的位范围以外的一个或者多个位生成矢量值。基于矢量值和多个浮点操作数生成用于浮点算术运算的结果值。
数据处理系统用于执行浮点算术运算方法装置

[发明专利]用于在多处理器数据处理中通信的系统和方法-CN201410699712.7在审
发明人： G·L·格思里;C·F·马里诺;M·S·西格尔;W·J·斯塔克;J·A·施蒂切利 -专利权人：国际商业机器公司
申请日： 2014-11-27 - 公布日： 2015-06-24 - 主分类号： G06F15/173 文献下载
摘要：本发明涉及一种用于在多处理器数据处理中通信的系统和方法。一个或多个系统、设备、方法和/或过程可以经由互连从处理节点接收消息，并且基于消息的第一部分的优先级或者基于消息的第二部分的到期时间，消息的所述第一部分可以取代消息的所述第二部分。在一个实例中，可以经由所述互连的结构控制器(FBC)的缓冲器存储消息的所述第二部分，并且与高于消息的所述第二部分的优先级关联的消息的所述第一部分可以在所述缓冲器中取代消息的所述第二部分。消息的所述第二部分可以包括推测命令。在另一个实例中，可以经由所述缓冲器存储消息的所述第二部分，并且与到期时间关联的消息的所述第二部分可以基于所述到期时间而取代消息的所述第二部分。
用于处理器数据处理通信系统方法

[发明专利]用于预测性选择预取操作的范围的数据处理系统和方法-CN200710141853.7有效
发明人： J·A·施蒂切利;B·L·古德曼;W·J·斯塔克 -专利权人：国际商业机器公司
申请日： 2007-08-14 - 公布日： 2008-02-20 - 主分类号： G06F12/08 文献下载
摘要：一种用于预测性选择预取操作的范围的数据处理系统包括：至少第一和第二一致性域，所述至少第一和第二一致性域的每个包含至少一个处理单元；耦合所述第一和第二一致性域的互连结构；以及所述第一一致性域中的高速缓冲存储器。所述高速缓冲存储器包括数据阵列、所述数据阵列的内容的高速缓存目录以及包括预取预测器的高速缓存控制器。所述预取预测器确定对于具有第一目标地址的第一预取操作在所述互连结构上的广播的预测范围，所述确定基于具有不同的第二目标地址的之前的第二预取操作的范围。所述高速缓存控制器以所述预测范围在所述互连结构上发出所述第一预取操作。
用于预测选择操作范围数据处理系统方法

[发明专利]数据处理的系统和方法-CN200710091163.5无效
发明人： J·A·施蒂切利;J·S·小菲尔茨;L·J·克拉克;W·J·斯塔克;B·L·古德曼 -专利权人：国际商业机器公司
申请日： 2007-04-11 - 公布日： 2007-10-17 - 主分类号： G06F15/163 文献下载
摘要：一种包括多个处理单元的数据处理系统，通过所述多个处理单元中的中间处理单元来传输所述处理单元中的多个不同处理单元间的通信中的至少一些通信。所述通信包括具有请求和代表对该请求的系统响应的组合响应的操作。每个中间处理单元至少包括：一个或多个发起第一操作的主机；至少接收由多个处理单元中的至少一个其他处理单元发起的第二操作的窥探器；存储由该处理单元中的一个或多个主机发起的第一操作的主机标签的物理队列；以及将票号分配给在中间处理单元处观察到的第二操作的票分配机制，所述票号指示相对于由中间处理单元观察到的其他第二操作的观察顺序。所述票分配机制将分配给操作的票号提供给窥探器以便与操作的组合响应一起处理。
数据处理系统方法

[发明专利]数据处理系统、高速缓存系统和方法-CN200610106290.3有效
发明人： G·L·格思里;J·A·施蒂切利;W·J·斯塔克;D·E·威廉斯;L·J·克拉克 -专利权人：国际商业机器公司
申请日： 2006-07-19 - 公布日： 2007-07-25 - 主分类号： G06F12/08 文献下载
摘要：一种高速缓存一致数据处理系统，所述系统包括至少第一和第二一致性域。在所述数据处理系统的所述第一一致性域内的第一高速缓冲存储器中，将存储器块保存在与地址标记和一致性状态字段关联的存储位置中。判定分配有与所述存储器块关联的地址的主系统存储器是否在所述第一一致性域内。如果否，则将所述一致性状态字段设置为指示以下项的一致性状态：所述地址标记有效，所述存储位置不包含有效数据，所述第一一致性域不包含所述主系统存储器，以及在形成所述一致性状态后，所述存储器块被缓存在所述第一一致性域之外。
数据处理系统高速缓存系统方法

[发明专利]选择操作的广播范围的数据处理系统、方法和处理单元-CN200610107723.7无效
发明人： J·D·麦卡尔平;W·J·斯塔克;J·A·施蒂切利;D·E·威廉姆斯 -专利权人：国际商业机器公司
申请日： 2006-07-21 - 公布日： 2007-07-25 - 主分类号： H04L12/56 文献下载
摘要：数据处理系统包括由互连结构相连接的至少第一和第二一致性域。连接到该互连结构的存储器包括地址转换表，该地址转换表具有被用来将虚拟存储器地址转换为实存储器地址的转换表项。该转换表项还包括用于目标为与该转换表项相关联的存储器区域内的地址的广播操作的范围信息。该第一一致性域内的范围预测逻辑通过参照该地址转换表项内的范围信息预测性地选择该数据处理系统的互连结构上的操作的广播范围。
选择操作广播范围数据处理系统方法处理单元

[发明专利]数据处理系统和方法-CN200610084674.X无效
发明人： B·L·古德曼;G·L·古思里;W·J·施塔克;J·A·施蒂切利;D·E·威廉姆斯 -专利权人：国际商业机器公司
申请日： 2006-05-29 - 公布日： 2006-12-06 - 主分类号： G06F12/08 文献下载
摘要：根据一种数据处理的方法，维护为在数据处理系统的互连上传输的一个或多个先前操作指示广播的历史范围的预测器。通过参考所述预测器来预测性地选择后续操作的广播的范围。
数据处理系统方法

[发明专利]数据处理系统和方法-CN200610067450.8有效
发明人： G·L·格思里;A·C·索蒂;W·J·斯塔克;J·A·施蒂切利 -专利权人：国际商业机器公司
申请日： 2006-03-27 - 公布日： 2006-10-04 - 主分类号： G06F12/08 文献下载
摘要：响应于主机接收到指示目标地址的存储器访问请求，所述主机访问高速缓存层次结构的高级高速缓存的第一高速缓存目录。响应于所述目标地址在所述第一高速缓存目录中被与具有有效地址标记和第一无效一致性状态的表项关联，所述主机在互连结构上发出指定了所述目标地址的请求，而不考虑所述高速缓存层次结构的低级高速缓存的第二高速缓存目录中与所述目标地址关联的一致性状态。响应于所述目标地址具有相对于所述第一高速缓存目录的第二无效一致性状态，所述主机在确定了所述高速缓存层次结构的所述低级高速缓存的所述第二高速缓存目录中与所述目标地址关联的一致性状态后，在互连结构上发出指定了所述目标地址的请求。
数据处理系统方法

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