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[发明专利]一种两级内插时间数字转换器电路-CN202110512172.7有效
发明人：封常青;董文豪;刘树彬;王君宸;沈仲弢;安琪 -专利权人：中国科学技术大学
申请日： 2021-05-11 - 公布日： 2022-10-28 - 主分类号： H03M1/50 文献下载
摘要：本发明提供一种两级内插时间数字转换器电路，包括：门控振荡器在触发电路输出的触发信号的控制下产生周期信号；中间内插计数电路在触发信号的控制下进行中间级时间内插；细延迟链内插电路接收门控振荡器产生的周期信号进行细计数内插；第一锁存电路对细延迟链内插电路输出的细延迟链原始数据进行锁存；第二锁存电路对中间内插电路输出的中间内插计数原始数据进行锁存；查找表电路基于编码后的细延迟链原始数据和编码后的中间内插计数原始数据，得到中间内插数据。在不降低测量精度的前提下，本发明与常规时间数字转换器电路相比，延迟链更短，编码更简单，极大减少逻辑资源消耗。
一种两级内插时间数字转换器电路

[发明专利]时间数字转换器延迟链内插的多沿变位置编码方法-CN201911403091.2有效
发明人：封常青;董文豪;刘树彬;陈昊磊;沈仲弢;王君宸;安琪 -专利权人：中国科学技术大学
申请日： 2019-12-30 - 公布日： 2021-04-23 - 主分类号： G04F10/00 文献下载
摘要：一种时间数字转换器延迟链内插的多沿变位置编码方法，该方法包括：将延迟链数据分片并行处理，对各片进行温度计码‑二进制码转换并得到标志位，将相邻片标志位进行异或处理；将相邻的多片合并成组，每组利用标志位异或结果确定沿变所在分片的位置序号及沿变类型；综合有沿变分片的位置序号、片内二进制码转换结果，根据应用需求输出一个或多个沿变位置编码。本发明提出的时间数字转换器延迟链内插的多沿变位置编码方法，将延迟链数据分片，充分利用硬件的并行性特点，有效节省逻辑资源量，并且根据片内统计信息确定沿变位置，能够达到和常用的逐一定位编码方法相同的精度。
时间数字转换器延迟内插多沿变位置编码方法