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[发明专利]一种比较器输出数字编码方法和3-bit/cycle高速ADC-CN202211615337.4在审
发明人：庄浩宇;曹毅睿;李强 -专利权人：电子科技大学
申请日： 2022-12-15 - 公布日： 2023-06-23 - 主分类号： H03M1/34 文献下载
摘要：本发明公开了一种比较器输出数字编码方法和3‑bit/cycle高速ADC，涉及模拟数字转换器技术领域。比较器输出数字编码方法包括：用D0表示ADC输入信号Vip‑Vin是大于0还是小于0；用D3D2D1表示ADC输入信号的绝对值大小；如果0|Vip‑Vin|(1/4)·VFS，则D3D2D1＝000；如果(1/4)·VFS|Vip‑Vin|(2/4)·VFS，则D3D2D1＝001；如果(2/4)·VFS|Vip‑Vin|(3/4)·VFS，则D3D2D1＝011；如果(3/4)·VFS|Vip‑Vin|VFS，则D3D2D1＝111。3‑bit/cycle高速ADC，包括一个电容型数字模拟转换器、一个电阻串、五个动态预放大器、四个与非门、四个锁存器以及两个反相器。本发明能将3‑bit/cycle高速ADC的电容型DAC数量从4个减少到1个，同时将锁存器数量从9个减少到4个，达到了简化电路、降低功耗的目的。
一种比较输出数字编码方法 bit cycle 高速 adc

[发明专利]一种用于低电压电路的高精度带隙基准电路-CN202211429505.0在审
发明人：庄浩宇;曹毅睿;张若凡;李强 -专利权人：电子科技大学
申请日： 2022-11-15 - 公布日： 2023-03-14 - 主分类号： G05F1/567 文献下载
摘要：本发明公开了一种用于低电压电路的高精度带隙基准电路，在现有Banba的低压基准源电路结构的基础上，通过设置反馈控制回路和采用NPN晶体管，实现了整个带隙基准电路对箝位放大器OP1失调电压VOS1不敏感。这个特性的意义在于，它极大地降低了带隙基准源电路对于箝位放大器OP1失调电压VOS1的要求，使得箝位放大器OP1不需要为了极低的输入失调电压而维持较大的功耗。在相同制造工艺下，输出基准电压精度处于同一水平的情况下，本发明方案中的OP1的功耗仅为现有技术的方案[3]中的OP1功耗的约1/9。同时，本发明整体电路的功耗仅为方案[3]中的40％。
一种用于电压电路高精度基准