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- [发明专利]上下文保存-CN02105102.X无效
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罗伯特·A·惠顿
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斯罗扬有限公司
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2002-02-20
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2002-12-11
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G06F9/38
- 公开了可在第一执行模式(诸如标量模式)和第二处执行模式(诸如VLIW模式)之间切换的一种处理器。该处理器当处于第一执行模式时具有第一处理器上下文,当处于第二执行模式时具有不同于第一处理器上下文的第二处理器上下文。当处理器试图从一个执行模式改变到另一执行模式时,处理器产生一异常。当处理器切换到第一执行模式的执行线程时,或者当处理器切换到原来是第二执行模式的最后线程的执行线程时,只保存第一处理器上下文。该处理器可这样配置,使得在任何一时间可能处于第二执行模式的线程数小于任何一时间在处理器上可能活动的线程总数。
- 上下文保存
- [发明专利]地址转换-CN02108306.1无效
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尼格尔·皮特·托法姆;林寿川
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斯罗扬有限公司
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2002-03-28
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2002-11-13
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G06F12/10
- 公开一种处理器,和一种访问该处理器中存储器的方法。该处理器为访问物理存储器而产生能变换为物理地址的虚地址,该物理存储器包括第一存储器部分(101)和第二存储器部分,第二存储器部分与第一存储器部分一样,是同一存储器级的一部分。当产生一虚地址时,该虚地址的一部分被变换为一局部的物理地址,并用该局部物理地址访问该第一存储器部分(101)内的存储器单元。与该存储器的访问并行,可以进行检验,以确定该局部物理地址是否正确。
- 地址转换
- [发明专利]处理器指令集-CN01135371.6无效
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奈杰尔·彼德·拖法姆
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斯罗扬有限公司
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2001-10-09
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2002-05-01
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G06F9/38
- 一个处理器分别具有第一和第二外部指令格式(F1,F2),其中由处理器接收指令(加法,加载)。每个指令具有一个指定某个要执行的操作的操作码(例如1011)。每个外部格式具有一或多个含有操作码的预先选择操作码位(F1i+1－i+4;F2i+1－i+3)。处理器还具有一个内部指令格式(G1),其中在执行操作之前将外部格式的指令转换成内部指令格式。可以在第一和第二外部格式(F1,F2)中指定一个第一操作(加法),并且可以在第二外部格式(F1)中指定一个第二操作(加载)。第一和第二操作在第二外部格式中具有不同的操作码(101,011)。在第一和第二外部格式共有的各个预先选择操作码位(i+1－i+3)中,两个外部格式中的第一操作(101)的操作码是相同的。这种“全等”指令编码允许在不需要主动识别各个单独的外部格式操作码的情况下简单并快速地执行将外部格式操作码转换成一个对应的内部格式操作码的转换过程。
- 处理器指令
- [发明专利]映射电路和方法-CN01104915.4无效
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奈杰尔·P·托帕姆
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斯罗扬有限公司
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2001-02-23
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2001-08-29
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G06F9/40
- 映射电路(40)包括一个第一个候选输出值产生装置(42),它产生一个第一个候选输出值(C1),该候选输出值(C1)与一个接收的输入值(r)相差一个第一个偏移值(x),和一个第二个候选输出值产生装置(44),当第一个候选输出值产生装置(42)进行工作产生第一个候选输出值(C1)时,它可以进行工作产生一个第二个候选输出值(C2),该第二个候选输出值(C2)与接收的输入值(r)相差一个第二个偏移值(y)。
- 映射电路方法
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