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[发明专利]多处理系统-CN96111046.5无效
发明人：保科聪;酒井浩;平山秀昭;大森誉史;藤井高广;增渊美生 -专利权人：株式会社东芝
申请日： 1996-06-19 - 公布日： 2002-12-11 - 主分类号： G06F15/16 文献下载
摘要：用于记录主存储器更新历程的运行记录存贮器，多个CPU将主存贮器的更新历程记录到两个运行记录存贮器的一个之内，并在校验点获得处将其上下文和高速缓冲存贮器的内容写入主存贮器。主存贮器的更新历程被从多个CPU中已经完成校验点处理的一个转换到多个记录存贮器中CPU尚未使用过的另一个内以记录主存贮器的更新历程。可以在不必等待多个CPU中其它一些CPU的校验点获得的情况下重新开始正常处理。
处理系统

[发明专利]清空高速缓冲存储器内容的装置-CN96107629.1无效
发明人：野末浩志;增渊美生 -专利权人：株式会社东芝
申请日： 1996-06-17 - 公布日： 2002-05-15 - 主分类号： G06F12/00 文献下载
摘要：总线接口与系统总线相连，监视表示处理器的高速缓冲存储器中数据更新的总线命令。如果高速缓冲存储器中数据更新，那么外部附加的存储设备存储表示数据更新的状态信息和对应于被更新数据的物理地址。当高速缓冲存储器中被更新数据存储在主存储器中时，外部附加的读出设备读出存储在外部附加存储设备中的状态信息。根据该状态产生从高速缓冲存储器向主存储器清空的总线命令。无效总线命令产生装置通过FIFO向系统总线输出无效总线命令。
高速缓冲存储器内容装置