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[发明专利]用于多相扫描的硬件去卷积块-CN201380076821.7有效
发明人：简-威廉·范德瓦尔特;阿伦·霍根;科尔姆·欧基夫;维克托·克雷米;沃洛季米尔·比达伊;保罗·凯莱赫 -专利权人：谱瑞科技有限公司
申请日： 2013-09-18 - 公布日： 2019-03-01 - 主分类号： G01R27/26 文献下载
摘要：描述了用于触摸阵列的多相扫描的硬件去卷积的设备和方法。一种设备包括被配置成存储包括卷积电容数据的电容图的存储器装置。所述卷积数据是利用多个TX模式的感测阵列的多相发送(TX)扫描的结果。所述设备还包括耦合到存储器装置的去卷积电路块。所述去卷积电路块被配置成利用所述多个TX模式的逆对卷积电容数据进行去卷积以获得去卷积电容图的电容数据。
用于多相扫描硬件卷积

[发明专利]定时同步的无线通信设备、集成电路和方法-CN200780049096.9有效
发明人：诺曼·比默什;保罗·凯莱赫;丹尼尔·B·施瓦茨 -专利权人：飞思卡尔半导体公司
申请日： 2007-01-02 - 公布日： 2009-11-11 - 主分类号： H04B1/40 文献下载
摘要：一种无线通信设备(100)包括第一子系统，第一子系统被设置成将数据传递至第二子系统，第二子系统包括操作地耦合至计数器(134)的定时同步逻辑(132)，以便当将数据从第一子系统传递至第二子系统时，由定时同步逻辑(132)对数据采样，其中，该无线通信设备(100)的特征是，定时同步逻辑(132)被设置成确定第一数据帧的位置，并且作为对其响应，发起计数器(134)的计数处理，以及确定第二数据帧的位置，并且作为对其响应，根据计数器(134)的计数处理确定计数值，并且响应该计数值，确定是否对被传送至第二子系统的数据发起定时提前或定时延迟操作。以这种方式，本发明概念为无线通信设备提供了实现定时同步的机制。具体而言，在3G DigRF无线通信设备(100)中，本发明概念可以允许射频集成电路(RFIC)通过将从数字基带电路发送的“实际”信号提前或延迟来实现定时同步。
定时同步无线通信设备集成电路方法

[发明专利]用于传送传输突发序列的方法和设备-CN200580049940.9有效
发明人：康纳尔·奥’基夫;丹尼斯·迪宁;保罗·凯莱赫 -专利权人：飞思卡尔半导体公司
申请日： 2005-03-30 - 公布日： 2008-05-21 - 主分类号： H04B7/26 文献下载
摘要：用于在无线设备中传送传输突发序列的方法和设备。该方法包括，根据传输调度来传送(430)传输突发序列。该方法的特征在于：在序列的至少一个传输突发的传送之前，在射频集成电路处接收(420)表示所述至少一个传输突发的传送的时序的信息；并且由实现传输调度的射频集成电路生成(440)时序信号。无线设备(100)包括基带集成电路(110)，其适于确定传输突发序列的传输调度。该无线设备的特征在于包括射频集成电路(200、300)，其适于接收表示时序调度的信息并且自主地控制传输突发序列的传送。
用于传送传输突发序列方法设备

[发明专利]无线通信设备和数据接口-CN200480044288.7有效
发明人：康纳·J·奥基夫;保罗·凯莱赫 -专利权人：飞思卡尔半导体公司
申请日： 2004-09-06 - 公布日： 2007-10-17 - 主分类号： H04B1/40 文献下载
摘要：一种无线通信设备(100)，包括多个子系统(110、120)，该多个子系统(110、120)可操作耦合到用于在多个子系统(110、120)之间发送数据的数据接口(105)。时钟产生功能模块(615)实质上是以将要在该数据接口(105)上使用的数据传送速率来产生时钟信号，由此在这样的速率上产生了时钟信号，即该速率最小化此无线通信设备(100)的操作频率上的时钟信号的谐波成分。因而，选择了合适的数据速率并且该数据速率由数据接口所支持，该数据接口提供了此无线通信设备(100)内的数据接口所耦合的功能元件所期望的带宽、时钟速率和/或码片速率，同时最小化来自时钟信号的谐波干扰的影响。
无线通信设备数据接口

[发明专利]装置及其控制接口-CN200480044264.1有效
发明人：康纳·J·奥基夫;保罗·凯莱赫;丹尼尔·施瓦茨 -专利权人：飞思卡尔半导体公司
申请日： 2004-09-07 - 公布日： 2007-09-26 - 主分类号： G06F13/38 文献下载
摘要：一种装置(100)，包括：多个子系统(110，120)和可操作耦合在多个子系统(110，120)之间以在其之间传送数据的控制接口(105)。选通脉冲生成功能部件(225，325)可操作耦合到控制接口(105)并且被构造以生成在不同的预期接收设备之间有所区别的多个不同的选通脉冲信号。所以，基于各个选通脉冲信号的脉冲宽度或电压幅度特性，可以在单个控制接口链路上多路复用不同的选通脉冲信号。选通脉冲解码器功能部件可操作耦合到控制接口(105)并被构造对在触发接收设备上的子系统之间有所区别的多个不同的选通脉冲信号进行解码。
装置及其控制接口