专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]具有区域凸块的覆晶封装结构、覆晶基板及覆晶组件-CN03153763.4有效
  • 洪志斌 - 日月光半导体制造股份有限公司
  • 2003-08-20 - 2005-02-23 - H01L23/48
  • 本发明是关于一种具有区域凸块的覆晶封装结构、覆晶基板及覆晶组件,该具有区域凸块的覆晶封装结构,其具有至少一晶片、一基板、多个第一凸块(一般凸块)及至少一第二凸块(区域凸块)。其中,这些第一凸块是分别电性及机械性连接晶片的多个第一焊垫之一至其所对应的基板的多个第一接触垫之一,而第二凸块亦分别电性及机械性连接晶片的第二焊垫至基板的第二接触垫,其中第二凸块的尺寸是大于这些第一凸块的个别的尺寸。值得注意的是,由于第二凸块的尺寸是大于这些第一凸块的个别的尺寸,所以该覆晶封装结构将具有较佳的电气效能及散热效能。
  • 具有区域封装结构覆晶基板组件
  • [发明专利]倒装片封装结构及其制备的方法-CN02143379.8无效
  • 方仁广 - 日月光半导体制造股份有限公司
  • 2002-09-26 - 2004-03-31 - H01L23/12
  • 本发明关于一种倒装片封装结构,包括:一芯片本体、一基底及一填充物。芯片本体包括至少一芯片,每一芯片外以封胶封装而形成芯片本体。基底承载芯片本体。填充物填充在芯片本体与基底间的区域,以形成倒装片封装结构。因此,当切割倒装片封装结构时,因芯片外有封胶保护,故切割时不会损坏芯片。并且,当激光蚀刻时,是印制在芯片外的封胶上,不会直接印制在芯片,因此也不会损坏芯片,可使封装的良率提高。
  • 倒装封装结构及其制备方法
  • [发明专利]具有静电放电防护的封装基板-CN02143174.4有效
  • 李孟苍;罗光淋 - 日月光半导体制造股份有限公司
  • 2002-09-16 - 2004-03-24 - H01L23/60
  • 本发明公开了一种具有静电放电防护的封装基板,该封装基板放置于一封装模具内,该封装模具设有多个活动式顶针,用以在封装后将该封装基板顶出该封装模具。该封装基板的第一铜网层及第二铜网层以定位孔电连接。该封装基板的底层具有多个凹槽,设置于该活动式顶针的相对位置,该等凹槽贯穿至该第二铜网层,以使该等活动式顶针与该第二铜网层电连接,静电电荷将由该第二铜网层引导至该等活动式顶针,并引导出静电电荷至该封装模具。本发明可使封装中的芯片可免于静电放电的破坏,以提高封装产品的合格率。
  • 具有静电放电防护封装
  • [发明专利]具有静电放电防护的封装模具-CN02142078.5有效
  • 洪志斌;蒋荣生 - 日月光半导体制造股份有限公司
  • 2002-08-26 - 2004-03-03 - H01L21/56
  • 本发明公开了一种具有静电放电防护的封装模具,其具有至少一凹槽,用以容纳至少一封装基板,该封装基板具有一第一高度的外侧壁。该凹槽用以容纳一封装基板,该凹槽具有一第二高度的内侧壁,该内侧壁与该封装基板的外侧壁电气接触,其中该第二高度大于该第一高度。藉此当该封装基板与该封装模具离模时,延长外侧壁与内侧壁的接触时间,从而使离模过程中产生的静电电荷由该封装模具引导出,不会残留在封装基板,使封装中的芯片可免于静电放电的破坏,以提高封装产品的良好率。
  • 具有静电放电防护封装模具
  • [发明专利]具有凹凸侧边的封装基板-CN02142075.0有效
  • 周光春;郑文吉 - 日月光半导体制造股份有限公司
  • 2002-08-26 - 2004-03-03 - H01L23/12
  • 本发明公开了一种具有凹凸侧边的封装基板。该封装基板由一板材切割而成,该板材可规划排列多个封装基板,并进而切割出多个封装基板;该封装基板包括:一第一侧边及一第二侧边。该第一侧边具有多个第一凸缘部及多个第一凹槽,各该第一凸缘部间界定各该第一凹槽,使得该第一侧边具有凹凸交错的边缘。该第二侧边包括多个第二凸缘部及多个第二凹槽,各该第二凸缘部间界定各该第二凹槽。该第一侧边及第二侧边成相对凹凸互补设计,从而使得该板材具有最密的封装基板排列。因此,该板材可以切割最佳数量的封装基板,不会造成部分板材的浪费,可节省大量的板材成本,对于整体的生产成本具有相当大的助益。
  • 具有凹凸侧边封装
  • [发明专利]具有静电放电防护的封装基板-CN02142076.9有效
  • 蒋荣生 - 日月光半导体制造股份有限公司
  • 2002-08-26 - 2004-03-03 - H01L23/12
  • 本发明公开了一种具有静电放电防护的封装基板。该封装基板的每一注模口电气连接至设置于该封装基板顶面周边的第一铜网层。当芯片封装过程中产生静电时,静电电荷将由注模口引导至第一铜网层,静电电荷聚集并限制于第一铜网层、介质层与第二铜网层所形成的电容,或者利用贯穿孔电气连接第一铜网层与第二铜网层,并经由金属垫及承载具引导出静电电荷。因此,利用电容效应或传导效应,可将封装过程中所产生的静电安全地导引出封装基板外,从而使封装中的芯片可免于静电放电的破坏,以提高封装产品的良好率。
  • 具有静电放电防护封装
  • [发明专利]具有静电放电防护的封装基板-CN02142079.3有效
  • 洪志斌;李永之 - 日月光半导体制造股份有限公司
  • 2002-08-26 - 2004-03-03 - H01L23/12
  • 本发明涉及一种具有静电放电防护的封装基板。该封装基板放置于一封装模具的凹槽内,该封装基板的外侧壁与该凹槽的内侧壁接触。该封装基板的第一铜网层及第二铜网层延伸至该外侧壁,从而使该第一铜网层及第二铜网层与该凹槽的内侧壁形成电连接。藉此当封胶过程中产生静电时,静电电荷由该第一铜网层或该第二铜网层引导至该模具凹槽的内侧壁,并引导出静电电荷。可将封装过程中所产生的静电安全地导引出封装基板外,从而使封装中的芯片可免于静电放电的破坏,以提高封装产品的良好率。
  • 具有静电放电防护封装
  • [发明专利]具有静电防护的封装模具-CN02142077.7无效
  • 李孟苍;罗光淋 - 日月光半导体制造股份有限公司
  • 2002-08-26 - 2004-03-03 - H01L21/56
  • 本发明公开了一种具有静电防护的封装模具,包括:一套筒区及至少一承载部。该套筒区具有多个套筒及流道,每一个套筒分支连通至该等流道,封胶即由各该等套筒压注至该等流道。承载部用以承载多个基底,并连接至该等流道,接收来自流道的封胶,以封装该等基底上的芯片。各该等承载部具有一承载面与该等基底接触,该承载面具有表面粗糙化处理,从而减少封装后离模时该等基底与该承载面间的静电。此外,该封装模具的该等流道具有表面粗糙化处理,从而减少封装后离模时流道内的封胶与流道间的静电。使封装后的芯片不致因静电过高而损坏,从而提高封装的良好率。
  • 具有静电防护封装模具
  • [实用新型]半导体封装的基板-CN99200744.5无效
  • 陈昆进;王武昌;吴世英;叶勇谊 - 日月光半导体制造股份有限公司
  • 1999-01-20 - 2000-03-22 - H01L23/00
  • 一种半导体封装的基板,基板表面上设有具有一注胶区域供注胶注入的焊接罩,薄膜黏贴于该基板的注胶区域上。该基板设有球格阵列集成电路。该基板的注胶位置位于注胶周围。该薄膜的非金属材料可为胶带、高分子化合物,也可为金属薄膜或非金属薄膜。在制造球格阵列集成电路的基板时,本实用新型应用在封装电子元件的注胶位置与基板之间,用以隔绝封胶与基板表面在注胶位置上发生直接接触的可剥离隔绝垫层的构造。
  • 半导体封装
  • [实用新型]电子元件堆叠装置-CN99200739.9无效
  • 陈昆进;李俊哲;叶勇谊 - 日月光半导体制造股份有限公司
  • 1999-01-20 - 2000-03-22 - H01L23/00
  • 本实用新型涉及电子元件封装装置。使之省导线、传输快。电子元件堆叠装置,其包含一基板、一上坑穴、一下坑穴、一上电子元件、一下电子元件及导线,其特征是;基板上表面及下表面间设一金属层;上坑穴从上表面贯穿至金属层,并形成上坑穴底部;下坑[穴从下表面贯穿至金属层并形成下坑穴底部;上电子元件置于上坑穴底部的金属层并覆盖一第一封胶体;下电子元件置于下坑穴底部的金属层并覆盖一第二封胶体。用于电子设备。
  • 电子元件堆叠装置
  • [实用新型]半导体装置的封胶体装置-CN99201395.X无效
  • 李俊哲;方仁广 - 日月光半导体制造股份有限公司
  • 1999-02-09 - 2000-03-15 - H01L21/56
  • 本实用新型涉及半导体装置的封胶装置,使之提高封胶质量。半导体装置的封胶体装置,其包括一基板、一晶片、一上胶体及其上模具及一下胶体及其下模具;其特征是基板包含一上表面及一下表面,并于基板设有一贯穿该上表面及下表面的孔;晶片位于基板下表面上;导线连接基板上表面的接点及晶片的接点;上胶体由上模具注入胶质材料形成,下胶体由下模具注入胶质材料形成,上胶体及下胶体将该晶片呈完全密封状态。用半导体装置封装。
  • 半导体装置胶体

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