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[发明专利]数据编码方法及其设备-CN202310334345.X在审
发明人：陈儒雅;徐诚羿;张晏硕;陈威任;邱茂清;提摩西·培林·费雪-杰费斯;李重佑 -专利权人：联发科技股份有限公司
申请日： 2018-01-24 - 公布日： 2023-06-30 - 主分类号： H03M13/11 文献下载
摘要：本发明描述了与具有低密度奇偶校验(LDPC)码的交织器的结构有关的概念和方案。设备的处理器编码数据，以提供编码数据。设备的收发器向无线网络的至少一个网络节点发送编码数据。在对数据编码以提供编码数据时，处理器编码数据，以使得编码数据中的各码块包括相应的比特级交织器。
数据编码方法及其设备

[发明专利]低密度奇偶校验码的偏移系数和提升因子设计方法-CN201880006223.5有效
发明人：邱茂清;提摩西·培林·费雪-杰费斯;李重佑;徐诚羿;张晏硕;陈威任;陈儒雅 -专利权人：联发科技股份有限公司
申请日： 2018-01-09 - 公布日： 2023-06-09 - 主分类号： H03M13/00 文献下载
摘要：本发明提出了用于NR QC‑LDPC码的偏移系数和提升因子设计的构思和方案。设备的处理器可生成QC‑LDPC码并使用所选择的码本对数据进行编码。在生成QC‑LDPC码时，处理器可定义多组提升因子，为多组提升因子中的每个提升因子生成各偏移量表，并使用基础矩阵和偏移系数表来生成QC‑LDPC码。通过利用本发明，可以更好地执行信息编码和解码。
密度奇偶校验码偏移系数提升因子设计方法

[发明专利]QC-LDPC编码方法、装置及非暂时性计算机可读介质-CN202111219885.0在审
发明人： 徐诚羿;李重佑;陈威任;邱茂清;提摩西·培林·费雪-杰费斯;陈儒雅;张晏硕 -专利权人：联发科技股份有限公司
申请日： 2018-05-04 - 公布日： 2022-01-18 - 主分类号： H03M13/11 文献下载
摘要：本发明涉及QC‑LDPC编码方法、装置及非暂时性计算机可读介质，尤其是涉及一种准循环低密度奇偶校验编码方法、装置及计算机可读介质，该装置确定包含在低密度奇偶校验(LDPC)编码的码字中的信息比特的码块大小(CBS)。所述装置将CBS与至少一个阈值进行比较，基于该比较的结果确定Kb数，并且基于码率和该Kb数确定Kp数。所述装置生成奇偶校验矩阵。该奇偶校验矩阵的信息部分是由M个第二方阵形成的第一矩阵。M等于Kp乘以Kb。所述Kb个第二方阵中的总列数等于CBS的总比特数。所述M个第二方阵中的一个或多个矩阵是循环置换矩阵。所述装置基于所述奇偶校验矩阵来操作LDPC编码器或LDPC解码器。
qc ldpc 编码方法装置暂时性计算机可读介质

[发明专利]QC-LDPC编码方法、装置及非暂时性计算机可读介质-CN201880002374.3有效
发明人： 徐诚羿;李重佑;陈威任;邱茂清;提摩西·培林·费雪-杰费斯;陈儒雅;张晏硕 -专利权人：联发科技股份有限公司
申请日： 2018-05-04 - 公布日： 2021-10-26 - 主分类号： H03M13/11 文献下载
摘要：一种准循环低密度奇偶校验编码方法、装置及计算机可读介质，该装置确定包含在低密度奇偶校验(LDPC)编码的码字中的信息比特的码块大小(CBS)。所述装置将CBS与至少一个阈值进行比较，基于该比较的结果确定Kb数，并且基于码率和该Kb数确定Kp数。所述装置生成奇偶校验矩阵。该奇偶校验矩阵的信息部分是由M个第二方阵形成的第一矩阵。M等于Kp乘以Kb。所述Kb个第二方阵中的总列数等于CBS的总比特数。所述M个第二方阵中的一个或多个矩阵是循环置换矩阵。所述装置基于所述奇偶校验矩阵来操作LDPC编码器或LDPC解码器。
qc ldpc 编码方法装置暂时性计算机可读介质

[发明专利]使用QC-LDPC码码本的无线通信方法及设备-CN201880001782.7有效
发明人：邱茂清;李重佑;提摩西·培林·费雪-杰费斯;徐诚羿;张晏硕;陈威任;陈儒雅 -专利权人：联发科技股份有限公司
申请日： 2018-06-01 - 公布日： 2021-06-18 - 主分类号： H04L1/00 文献下载
摘要：设备的处理器从准循环低密度奇偶校验码中嵌入的多个码本中选择码本。处理器将所选的码本储存在与所述处理器相关联的存储器中。处理器也使用所选的码本编码数据，来产生所述数据的多个调制符号。处理器还控制所述设备的传送器通过所述设备的一个或多个天线来复用、转换、滤波、放大和发射所述调制符号为电磁波。在从所述准循环低密度奇偶校验码中嵌入的多个码本中选择码本时，处理器根据一个或多个规则选择所述码本，以便选择需要较短编码处理延迟的小码本用于所述编码，除非对应于更长编码处理延迟的更大码本对于所述编码来说是必要的。通过利用本发明，可以更好地进行使用QC‑LDPC码码本的无线通信。
使用 qc ldpc 无线通信方法设备

[发明专利]通信方法和装置-CN201880000697.9有效
发明人：李重佑;徐诚羿;邱茂清;提摩西·培林·费雪-杰费斯;陈儒雅;张晏硕;陈威任 -专利权人：联发科技股份有限公司
申请日： 2018-02-05 - 公布日： 2021-05-25 - 主分类号： H04L1/00 文献下载
摘要：本发明各个方面提供了一种包括发送电路和处理电路的装置。所述发送电路被配置成发送无线信号。所述处理电路被配置成，利用被配置用于增量冗余的代码对信息比特组进行编码，以生成包括所述信息比特和奇偶校验比特的码字，在循环缓冲区中缓冲所述码字，基于从根据与所述信息比特组相关联的先前发送的场景评估的多个冗余版本中选择的冗余版本，确定所述循环缓冲区中的开始位置，以及经由所述发送电路从所述开始位置发送所述码字的选定部分。
通信方法装置

[发明专利]用于通信中的纠错编码的方法和装置-CN201880000877.7有效
发明人：李重佑;提摩西·培林·费雪-杰费斯;邱茂清;陈威任;徐诚羿;陈儒雅;张晏硕 -专利权人：联发科技股份有限公司
申请日： 2018-03-16 - 公布日： 2020-06-12 - 主分类号： H04L1/00 文献下载
摘要：本发明各方面提供了一种用于基于矩阵进行纠错的装置和方法。该装置包括存储器和处理电路。所述存储器被配置成存储与奇偶校验位的集合关联的矩阵。具有多行多列的所述矩阵包括具有与第一状态或第二状态对应的值的元素。所述矩阵还包括具有值与所述第一状态对应的两个元素的行。所述两个元素中的一个是对应于与所述行关联的奇偶校验位的奇偶校验元素。另外，与所述奇偶校验元素在同一列中的其它元素具有与所述第二状态对应的值。所述处理电路被配置成基于所述矩阵来实现纠错。本发明提供的用于通信中的纠错编码的方法和装置可纠正数据传输错误。
用于通信中的纠错编码方法装置

[发明专利]具有交错功能的NR LDPC-CN201780046956.7在审
发明人：提摩西·培林·费雪-杰费斯;陈威任;陈儒雅;邱茂清;张晏硕;徐诚羿 -专利权人：联发科技股份有限公司
申请日： 2017-11-03 - 公布日： 2019-04-16 - 主分类号： H04L1/00 文献下载
摘要：描述了用于移动通信的与信息编码有关的概念和方案。装置的处理器对数据进行编码，以提供编码数据。处理器还将该编码数据发送给无线网络的网络节点。在对该数据进行编码中，处理器利用低密度奇偶检查(LDPC)码对该数据进行编码，以提供基于LDPC编码的数据。此外，处理器利用前向纠错(FEC)稳定性增强功能对基于LDPC编码的数据进行处理，以提供该编码数据。FEC稳定性增强功能包括：交错功能，对该基于LDPC编码的数据进行交错操作，以提供该编码数据；间隔交错功能，对该基于LDPC编码的数据进行间隔交错操作，以提供该编码数据，或位重排序功能，对该基于LDPC编码的数据的位进行重排序，以提供该编码数据。
编码数据处理器稳定性增强间隔交错交错功能重排序功能前向纠错网络节点无线网络信息编码移动通信重排序奇偶交错检查

[发明专利]干扰消除的方法及装置-CN201610822779.4有效
发明人： 徐诚羿;邱茂清;孙伟男 -专利权人：联发科技股份有限公司
申请日： 2016-09-14 - 公布日： 2018-11-30 - 主分类号： H04J11/00 文献下载
摘要：本发明提供一种干扰消除装置及方法，其中，该干扰消除装置包括：前端处理电路，用于接收至少一干扰信号和所需信号；内部处理电路，用于信道/噪声估计且用于抑制该干扰信号；以及多输入多输出处理电路，用于根据该抑制的干扰信号盲测该干扰信号的干扰参数，且用于从该所需信号中消除该干扰信号且根据该检测的干扰参数和来自该内部处理电路的该信道/噪声估计本发明提供的装置精确执行干扰消除，改进装置性能。解调该所需信号。
干扰消除方法装置

[发明专利]具有LDPC码的交织器的结构-CN201880000471.9在审
发明人：陈儒雅;徐诚羿;张晏硕;陈威任;邱茂清;提摩西·培林·费雪-杰费斯;李重佑 -专利权人：联发科技股份有限公司
申请日： 2018-01-24 - 公布日： 2018-10-09 - 主分类号： H03M13/13 文献下载
摘要：本发明描述了与具有低密度奇偶校验(LDPC)码的交织器的结构有关的概念和方案。设备的处理器编码数据，以提供编码数据。设备的收发器向无线网络的至少一个网络节点发送编码数据。在对数据编码以提供编码数据时，处理器编码数据，以使得编码数据中的各码块包括相应的比特级交织器。
编码数据交织器处理器编码低密度奇偶校验发送编码数据数据编码网络节点无线网络比特级收发器码块

[发明专利]利用LDPC码的交织器的位置-CN201880000468.7在审
发明人：陈威任;陈儒雅;张晏硕;提摩西·培林·费雪-杰费斯;邱茂清;徐诚羿;李重佑 -专利权人：联发科技股份有限公司
申请日： 2018-01-24 - 公布日： 2018-10-09 - 主分类号： H04L1/00 文献下载
摘要：本发明描述了与利用低密度奇偶校验(LDPC)码的交织器的位置有关的概念和方案。装置的处理器对数据进行编码以提供编码数据流。该处理器还对编码数据进行速率匹配以提供经速率匹配的编码数据流。该处理器还对经速率匹配的编码数据流进行交织。在对编码数据进行速率匹配时，所述处理器在循环缓冲器中缓冲所述编码数据流，且循环缓冲器用作对编码数据流进行速率匹配的速率匹配块。在对经速率匹配的编码数据流进行交织时，所述处理器对经速率匹配的编码数据流执行位级交织以提供交织数据流。
速率匹配编码数据流处理器编码数据交织器低密度奇偶校验循环缓冲器数据流循环缓冲缓冲

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