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- [发明专利]可变与行程编码数据的接收-CN98804416.1无效
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H·佩恩;J·迪安;M·巴克穆特斯基;R·沈
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皇家菲利浦电子有限公司
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1998-12-14
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2000-05-10
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H03M7/44
- 在接收机中,可变长度解码器(VLD)从诸如MPEG编码数据等可变与行程编码数据(ED)中导出行程值对(RVP)。行程值对(RVP)包括系数值(CV)及行程长度(RL)。行程长度(RL)指示在该系数值(CV)前面的零系数(O)的个数(N),N为整数。处理电路(PRC)处理行程值对(RVP)得出解码的数据流(DD)。处理电路(PRC)包括时钟电路(CLC)及控制电路(CON)。时钟电路(CLC)生成与解码的数据流(DD)同步的时钟周期(CC)。随着具有不等于零的行程长度(RL)的各行程值对(RVP),控制电路(CON)停止可变长度解码器(VLD)(N)个时钟周期(CC)。时钟周期数(N)与行程长度(RL)所指示的零系数的数量(N)成正比。在这一接收机中,处理电路(PRC)需要相对小的缓冲存储器,从而允许成本高效的实现。
- 可变行程编码数据接收
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