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[发明专利]卷积码译码器输入信息的控制方法和装置-CN201310277921.8有效
发明人：秦信江;巫戈明 -专利权人：展讯通信（上海）有限公司
申请日： 2013-07-03 - 公布日： 2017-04-26 - 主分类号： H03M13/23 文献下载
摘要：一种卷积码译码器输入信息的控制方法和装置，所述控制方法包括所述当前执行周期写入输入信息的存储单元至所述存储空间的最后一个存储单元总的个数小于等于M‑1时，复制所述当前执行周期写入的输入信息并进行存储，其中，所复制的输入信息，按照复制的先后顺序，依次存储在所述存储空间中第一存储区域的存储单元中，同时覆盖所述存储单元中原有的输入信息；所述当前执行周期写入输入信息的存储单元为所述存储空间的最后一个存储单元时，下一执行周期写入输入信息的存储单元为与上一次存储所述复制的输入信息的存储单元相邻的下一存储单元。应用本发明所述的控制方法，可以使用通用的卷积码译码器进行译码，减少卷积码译码器的制作成本。
卷积码译码器输入信息控制方法装置

[发明专利]一种并行编码和交织的通信传输方法-CN201510646123.7在审
发明人：罗艺华;钱骅;朱正航 -专利权人：上海无线通信研究中心;中国科学院上海微系统与信息技术研究所
申请日： 2015-10-08 - 公布日： 2017-04-19 - 主分类号： H03M13/23 文献下载
摘要：本发明提供了一种并行编码和交织的通信传输方法，包括步骤S1、以整帧为单位按并行度N对数据进行并行编码；S2、将编码后的数据打孔后存入缓存池中；S3、从所述缓存池中读取数据并以交织符号比特数K对数据进行符号划分；并按并行度2N对数据进行交织，并将待交织的数据存入对应存储器中；S4、利用交织地址读取所述存储器中的数据，并将数据输出。本发明将N bit并行编码器、2N bit缓存池和并行交织器一起组成整体。该并行编码，并行交织整体可灵活适配多种不同的码率，不同的数据率，大大提高了发送端的数据吞吐率。且系统设计简单易行，消耗资源少，可扩展性强，特别适合FPGA平台上设计实现工作。
一种并行编码交织通信传输方法

[实用新型]一种低资源消耗的多参数可配置Viterbi译码器-CN201621063506.8有效
发明人：虞致国;谢益祺;石乔林;顾晓峰 -专利权人：江南大学
申请日： 2016-09-19 - 公布日： 2017-04-12 - 主分类号： H03M13/23 文献下载
摘要：本实用新型涉及一种低资源消耗的多参数可配置Viterbi译码器，包括输入配置单元，用于将译码输入标准化；标准码计算单元，用于计算标准卷积码；分支度量计算单元，用于计算分支度量值；网格运算单元，用于重构网格图，并计算状态度量值和幸存路径；状态度量存储比较单元，用于存储并比较状态度量值，计算回溯索引值；幸存路径存储单元，用于存储幸存路径；回溯单元，用于根据幸存路径和回溯索引值重建译码序列。本实用新型中标准码计算单元使用迭代运算的方法，降低了资源消耗，并支持3‑9的可变约束长度、任意输入的可变约束多项式和1/2、1/3、1/4的可变码率，可用于多种通信协议中的信道解码工作。
一种资源消耗参数配置 viterbi 译码器

[发明专利]卷积交织/解交织的实现方法及装置-CN201410157910.0有效
发明人：黄戈;梁伟强;王白羽;钱宏达;李瑞;郑成根;江陶;柯仙胜;薛亚萍 -专利权人：上海高清数字科技产业有限公司
申请日： 2014-04-18 - 公布日： 2017-03-22 - 主分类号： H03M13/23 文献下载
摘要：本发明提出了一种提高总线效率和降低DDR带宽的卷积交织/解交织实现方法和装置，其至少包括根据发送/接收系统交织传输速率计算出DDR最小占用带宽；根据卷积交织参数计算出最小占用带宽时所需DDR存储空间；根据DDR参数、AXI总线参数、交织参数计算出数据整形存储器参数以及产生Local地址、AXI总线连读或连写长度范围；根据产生的数据整形存储器参数,local地址规则，转换到AXI总线地址，完成和DDR的数据交互；该方法以降低DDR带宽和提高总线效率为优先考量，对存储规则和读写地址进行特殊设计，使得将交织对DDR带宽的占用最小化，同时大幅提高总线的读写效率。
卷积交织实现方法装置

[发明专利]应用于一卷积编码信号的解码方法-CN201510540472.0在审
发明人：顾育先 -专利权人：晨星半导体股份有限公司
申请日： 2015-08-28 - 公布日： 2017-03-08 - 主分类号： H03M13/23 文献下载
摘要：本发明提供一种应用于一卷积编码信号的解码方法，该方法包含下列步骤(a)以一第一调整因子调整一第一输入信息，以产生一第一先验信息；(b)依据一系统信息与该第一先验信息对该卷积编码信号进行解码，产生一第一外部信息；(c)以一第二调整因子调整一第二输入信息，以产生一第二先验信息，其中该第二调整因子是依据该第一外部信息与该第一先验信息而产生；以及，(d)依据该系统信息与该第二先验信息对该卷积编码信号进行解码，产生一第二外部信息。其中，步骤(b)和(d)其中之一更产生一后验信息以作为一解码结果。
应用于卷积编码信号解码方法

[发明专利]具有速率匹配的高计算效率的卷积编码-CN201310361555.4有效
发明人： J-F.程 -专利权人：艾利森电话股份有限公司
申请日： 2008-06-06 - 公布日： 2017-03-01 - 主分类号： H03M13/23 文献下载
摘要：一种差错编码电路，包括非系统性卷积编码器，用于对输入比特流进行编码以产生两组或更多组奇偶校验比特；交织器电路，用于对每组奇偶校验比特内的奇偶校验比特进行交织；以及速率匹配电路，用于输出选定数目的交织的按组排序的奇偶校验比特以获得期望码率。
具有速率匹配计算效率卷积编码

[发明专利]一种结构化LDPC卷积码构造编码方法-CN201310138045.0有效
发明人：刘星成;穆丽伟 -专利权人：中山大学
申请日： 2013-04-19 - 公布日： 2017-02-22 - 主分类号： H03M13/23 文献下载
摘要：本发明公开了一种具有快速编码特性的结构化LDPC卷积码编码方法，其步骤为输入参数q，n，生成有限域GF(q)上码长为n的MDS码；输入参数R，生成矩阵WQC，对矩阵WQC中每个非零元素进行二元扩散，生成矩阵HQC，根据环同构原理，由HQC生成矩阵Hconv(D)；t时刻输入信息码字ut，t时刻前n‑J个编码比特可由式(I)获得，t时刻其它编码比特可由式(II)获得，根据上述步骤获得t时刻编码码字vt＝[vt(I)，...，vt(n)]。本发明提出的编码方法具有可直接由奇偶校验矩阵进行快速编码，节省存储空间，提高编码速度，性能优异等优点。
一种结构 ldpc 卷积码构造编码方法

[发明专利]一种咬尾卷积码译码方法-CN201110202238.9有效
发明人：王晓涛;钱骅;徐景;黄浩;杨旸 -专利权人：上海无线通信研究中心
申请日： 2011-07-19 - 公布日： 2017-02-22 - 主分类号： H03M13/23 文献下载
摘要：本发明公开了一种咬尾卷积码译码方法，该方法基于循环维特比译码算法，根据接收到的软信息序列，通过迭代对不可能的起始状态逐一排除，最终寻找到最优咬尾路径。本发明通过多次迭代将所有不可能的状态排除，只有和接收序列最相似的咬尾路径的起始状态才幸存下来，最后算法收敛到最优的咬尾路径输出；此外，它还通过得到的幸存咬尾路径来更新最大似然咬尾路径的度量值或者从起始状态中将不可能的起始状排除，有效地解决了循环陷阱问题导致的算法不收敛性，解决了咬尾卷积码没有实用的最优译码算法的困境，降低了现有译码方案的复杂度。
一种卷积码译码方法

[发明专利]一种关于分组马尔可夫叠加编码的两阶段译码方法-CN201410132068.5有效
发明人：马啸;梁楚龙;庄秋涛;白宝明 -专利权人：中山大学
申请日： 2014-03-28 - 公布日： 2017-02-15 - 主分类号： H03M13/23 文献下载
摘要：本发明属于数字通信和数字存储领域，特别涉及一种关于分组马尔可夫叠加编码的两阶段译码算法，其对应由输入k长输出n长的基本编码器构造的记忆为m的分组马尔可夫叠加编码，用于从L+m个均为n长的接收向量y(0)…y(L+m‑1)中恢复经过叠加编码的L组均为k长的二元信息序列u(0)…u(L‑1)，对于延迟为d的第一阶段译码，包括以下步骤对于t＜d，把中间结果初始化为全零序列。对于t≥d，首先，若t＜L+d，执行第一阶段译码，得到n长译码结果接着，若t≥d+m，进行第二阶段译码1)干扰移除从接收向量中移除中间结果得到关于信息u(t‑d‑m)的m+1个向量2)基本码译码把m+1个向量结合为一n长向量送入基本码译码器，得到k长译码结果
一种关于分组马尔可夫叠加编码阶段译码方法

[发明专利]一种基于分组马尔可夫叠加编码的多码率码编码方法-CN201410132013.4有效
发明人：马啸;胡竞男;梁楚龙;白宝明 -专利权人：中山大学
申请日： 2014-03-28 - 公布日： 2017-02-15 - 主分类号： H03M13/23 文献下载
摘要：本发明属于数字通信和数字存储领域，特别涉及一种基于分组马尔可夫叠加编码的多码率码编码方法，用于将长度为K＝kBL的二元信息序列编码为长度为nB(L+mk)的码字其中n>1，k取值{1，2，…，n‑1}，即码率集合为{1／n，2／n，…，(n‑1)／n}，L为等长kB序列分组的数量，mk是每个码率为k/n的子码的记忆长度，包含以下步骤首先，信息序列划分为L个等长分组对于t=‑1，‑2，…，‑(mk‑1)，‑mk，把长度为nB的序列初始化；然后，在t=0，1，…，L‑1时刻，将长度为kB的序列分成B组送入由n维方阵H定义的变换进行编码，得到长度为nB的编码序列v‾(t)=(v0(t),v1(t),...,vnB-1(t)),]]>并结合计算码字的第t个子序列本发明提出的多码率码设计简单、码率范围广且性能优越。
一种基于分组马尔可夫叠加编码多码率码方法

[发明专利]一种分组马尔可夫叠加编码方法-CN201310019348.0有效
发明人：马啸;梁楚龙;黄科超;庄秋涛 -专利权人：中山大学
申请日： 2013-01-17 - 公布日： 2016-11-09 - 主分类号： H03M13/23 文献下载
摘要：本发明属于数字通信和数字存储领域，特别涉及一种分组马尔可夫叠加编码方法，用于将长度K＝kL的信息序列u编码为码字c，包括以下步骤：首先，将信息序列u划分为L个等长分组u＝(u⁽⁰⁾，u⁽¹⁾，…，u^(L‑1))，同时对于t＝‑1，‑2，…，‑(m‑1)，‑M，把长度为n的序列v^(t)初始化；然后，在t＝0，1，…，L‑1时刻，将长度为k的序列送入编码器C进行编码，得到长度为n的编码序列并结合v^(t‑1)，v^(t‑2)，…，v^(t‑m)计算码字c的第t个子序列c^(t)。
一种分组马尔可夫叠加编码方法

[发明专利]卷积编码的解码方法-CN201510078183.3在审
发明人：顾育先 -专利权人：晨星半导体股份有限公司
申请日： 2015-02-13 - 公布日： 2016-10-05 - 主分类号： H03M13/23 文献下载
摘要：本发明提供一种应用于一卷积编码信号的解码方法，该卷积编码信号是包含一栅格，该方法包含：自该栅格决定多个第一子栅格；解码该多个第一子栅格；自该栅格决定多个第二子栅格，该多个第二子栅格的终端点不同于该多个第一子栅格的终端点；以及，解码该多个第二子栅格。
卷积编码解码方法

[发明专利]一种卷积编码实时译码装置及方法-CN201610089174.9在审
发明人：杨丽莎;郑彬;向为;张华;彭果;易文鑫;朱增贤;王帅 -专利权人：湖南北云科技有限公司
申请日： 2016-02-17 - 公布日： 2016-07-13 - 主分类号： H03M13/23 文献下载
摘要：本发明公开了一种卷积编码实时译码装置及方法，在译码器中增加一个帧头检测单元以及一个数据源切换单元。利用帧头检测单元实时检测译码结果是否含有正确的帧头，如果无正确帧头则控制数据源切换单元将输入的待译码数据错开一个数据位，再重新开始译码，直到译码正确为止，本发明不需要额外的辅助即可实现从任意起始位置开始译码，大幅降低了接收机的实现复杂度。
一种卷积编码实时译码装置方法

[发明专利]一种尾码可配置的Viterbi解码方法及解码器-CN201510824179.7在审
发明人：韩冬;车广庆;唐会彦;孙刚;苏泳涛;石晶林 -专利权人：中国科学院计算技术研究所
申请日： 2015-11-24 - 公布日： 2016-02-24 - 主分类号： H03M13/23 文献下载
摘要：本发明提供一种尾码可配置的Viterbi解码方法及解码器，所述方法包括：步骤1)、量化待解码的数据，其中，针对咬尾编码方式在量化后的码块前加入从该量化后的码块尾部截取的数据；步骤2)、对步骤1)得到的数据进行网格计算处理，形成状态网格信息，其中，所述状态网格信息用于指示网格图中的状态之间的关系；步骤3)、根据所述状态网格信息，从回溯的起始状态开始进行回溯处理得到逆序的解码结果，并且将所述逆序的解码结果正序输出。本发明提供的Viterbi解码方法及解码器能够针对咬尾和零尾卷积码进行Viterbi解码，同时能够快速有效地完成规定计算，适用于多种通信标准，并且不会占用过多额外资源。
一种尾码配置 viterbi 解码方法解码器

[发明专利]一种译码方法及装置-CN201310556951.2在审
发明人：洪小斌;伍剑;郭宏翔;李蔚 -专利权人：北京邮电大学
申请日： 2013-11-11 - 公布日： 2015-05-20 - 主分类号： H03M13/23 文献下载
摘要：本发明公开了一种译码方法及装置，涉及通信技术领域，所述方法包括：S1：对待解调信号进行解调，以获得符号信息；S2：对所述符号信息进行比特量化，以获得各个符号的量化值；S3：遍历各个符号，在当前符号代表的信息比特数为x时，则将所述当前符号对应的x级状态进行组合分析，获取并分配所述x级状态中各级状态可能接收的所有比特组合，计算所述x级状态中各级状态的权值和输出比特；S4：将权值最小的一条路径作为幸存路径；S5：对所述幸存路径进行回溯，将所述幸存路径上各级状态的输出比特作为译码结果。本发明应用于两点式标量解调系统中，通过基于符号的译码，而无需增加额外的电路，在不增加成本的情况下，提高了译码的信噪比。
一种译码方法装置